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[参考译文] LMK00101:问题

Guru**** 2390755 points
Other Parts Discussed in Thread: LMK00101, LMK00105, LMK00804B

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1072581/lmk00101-questions

部件号:LMK00101
“线程”中讨论的其他部件: LMK00105LMK00804B

您好,

我们一直在研究 LMK00101,但我们有一些顾虑:

  • 如果我们只有2个输入和4个输出,是否建议不要连接未使用的端口?
  • 我想知道您是否有 LVCMOS 时钟输入转换速率为~0.375 V/ns (附加抖动,噪声地板增加多少等)的部件性能数据?
  • 对于 LMK00101,OSCin 引脚的输入偏压是多少?  它是否取决于我们选择的 Vdd 内核电源电压?

  • 我们是否能够使用单端正弦波驱动 OSCin 或 CLKinx 引脚?

谢谢,
亚当

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    亚当

    • LMK00105只有两个输入和四个输出,(2个输入,5个输出)可能是更好的选择-请注意,OSCin 接口可以作为单端 LVCMOS 输入驱动(参见 LMK00105数据表中的图8或 LMK00101数据表中的图11)。 对于任何一种设备,未使用 的输入和输出都应保持浮动状态-输入可以根据 表2和表3中给出的指导保持浮动,输出可以根据数据表指导保持浮动状态,而使用的输出小于所有输出。
    • 我们没有这些特定数据。 但从 数据表的图2和图3中的图解来看,应该清楚的是,噪声层将会显著增加——只要从最后一个数据点进行线性外推,它就像几百股增压抖动。 我不建议在输入转换率低于2V/ns 的情况下操作设备。
    • OSCin 引脚的输入偏压名义上是 VDD/2。 这可以从图8 (LMK00105)或图11 (LMK00101)交流耦合外部 LVCMOS 驱动程序和 OSCin 引脚中推断出来。
    • 只要 OSCin 和 CLKinX 引脚 符合电气特性中列出的单端输入规格,就可以使用单端正弦波驱动。  OSCin 未列出输入规格,但 具有与 CLKIN 输入相当的信号摆幅要求。

      请注意,使用正弦波的最大问题是受限的转换率; 如上所述,理想情况下,您需要2V/ns 或更高的频率才能获得合适的附加抖动性能。 对于单端正弦波,转换率取决于频率:SR = 2π*f*Vpk。  最大单端摆动被指定为2Vpp,因此 Vpk 最多为1V;这意味着要获得2V/ns 的回转率,频率必须>(2V/ns)/ 2π*1V > 318MHz,这超出了 OSCin 引脚的最大工作频率范围。   您可能更幸运地驾驶一个平衡器获得差分正弦波,因为这会将转换速率增加一个 sqrt (2)的倍数,从而将最大允许频率降低到(2V/ns)/(2π*sqrt (2)* 1V)=大约225MHz,而不会增加任何放大; 如果在输入时将功耗再增加3dB,您将获得另一个 SQrt (2)振幅改进,现在您可以在2V/ns 时提高159MHz。 无论如何,单端正弦波显然是在更低频率下实现必要的切换率的挑战。

      我还想指出,LMK00804B 具有 LVCMOS 输入和差分输入,并显示了类似的趋势,增加了抖动和噪声地面与输入转换率。 您需要高频和高功率正弦波,或者您需要一个比功率建议更高的切换正弦波,或者您需要一个正弦到方波转换器来保持近入噪声性能 (例如,请查看 此链接 第3.4.1.1节,以讨论 10MHz 铑振荡器中使用的正弦到方技术), 随后可能会出现 抖动消除 PLL,该 PLL 可以在较低频率下产生高转换率的输出,从而产生比逻辑器件所能提供的噪音低得多的噪声地面(尽管在上面的链路中有一些100kHz 的数据表明可能不需要这样做)。 低频低噪声正弦到方形转换是一个棘手的问题, 我们的 LVCMOS 缓冲器无法为您解决该问题。

    此致,

    德里克·佩恩