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[参考译文] LMX2820EVM:SRREQ_P/N 引脚

Guru**** 1125150 points
Other Parts Discussed in Thread: LMX2820, LMK1D2102, LMK1D1204, CDCLVC1102
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1079738/lmx2820evm-srreq_p-n-pins

部件号:LMX2820EVM
线程中讨论的其他部件:LMX2820LMK1D2102LMK1D1204CDCLVC1102

你(们)好

我们希望将 PLL LMZ2820用作 sysref 生成器。

我正在附加 TIC pro 配置文件:sysref 频率约为39 MHz,由内部 VCO 生成。

sysref 信号的生成似乎正确(请参阅随附的度量)。

但要生成此信号, SRREQ 引脚需要高电平。 为什么? sysref 来自内部 VCO,而不是 SRREQ 引脚。  

这些引脚的含义是什么?

请提前感谢。

此致,

Matteo Ricci

 e2e.ti.com/.../CLK_5F00_5G_5F00_FPGA_5F00_312M5_5F00_SYS_5F00_REF_5F00_39M0625.tcs

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    Matteo,

    我认为 LMX2820数据表或 TIC Pro 配置文件在解释这一点方面做得不好,但在主模式 下,您仍需要声明 SRREQ 过高以生成连续的 SYSREF 输出或触发 SYSREF 脉冲。 在中继器模式下,SYSREF 输出严格来说是 SRREQ 引脚的缓冲副本,输出边缘会重新定时显示给 VCO。

    供参考:

    • CE 是芯片启用,设备需要保持活动状态才能达到较高的水平
    • 静音将静音输出
    • SRREQ 是 SYSREF 请求引脚,用于在主模式下激活连续或触发脉冲 SYSREF,以及 在中继器模式下激活缓冲副本
    • PSYNC 是相位同步引脚,用于需要定时关键同步的情况

    此致,

    德里克·佩恩

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    您好,

    非常感谢您的快速回答。

    因此,如果我想从内部 VCO 使用 sysref,我可以将 sysref 设置为连续或脉冲模式。 正确吗?

    一些问题:

    1) SSREQ 引脚的电气连接是什么?  

    2) sysref 输出信号的电气标准是什么? (LVDS,LVPECL...?)

    请提前感谢。

    此致。

    Matteo  

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    您好,Matteo,

    正确,此设备支持连续和脉冲模式 sysref 生成。

    SRREQ 引脚可以配置为 CMOS 或 LVDS。 我注意到您没有使用最新的 TIC Pro,请安装最新版本。 GUI 可以选择 SRREQ 输入格式。 最新的集成电路 Pro 有一个已知错误,其 R64[14]默认为=1。 如果需要 SYSREF,请手动将该位更改为0。 此问题将在下一版本中得到解决。

    SRO 是 一个700mV (单端)摆动差速器信号,内部端接为50Ω Ω。  

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    Noel,您好!

    感谢您的回答。

    您是否可以建议我使用一个缓冲区1:2将 sysref 分发给两个接收器?

    谢谢你,

    Matteo

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    Matteo,

    我会提出一些建议:

    • 对于直流耦合 LVDS,LMK1D1204 (1:4,但您可以保留两个未使用的输出)或 LMK1D2102 (2个1:2缓冲器,您可以保留一半未使用)。
    • 如果您需要单端信号,可以使用 CDCLVC1102 (尽管获取库存将是一项挑战)。

    此致,

    德里克·佩恩