[参考译文] LMX2820：输入 OSCIN 模式以获得最佳相位噪声性能

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1077762/lmx2820-input-oscin-mode-for-best-phase-noise-performance

部件号：LMX2820

您好，

我正在一个新项目中使用 LMX2820。 输入参考时钟为100 MHz，输入功率> 10 dBm。 此参考时钟发送至功率分配器，插入损耗约为8 dB。 
因此，LMX2820的参考时钟输入功率约为5 dBm。

为了获得良好的相位噪声性能，输入参考时钟的最佳配置是什么？ 

1.单端还是差动模式？ 
2.正弦波还是脉冲波？ 
3.差动输入的转换速率大于单端输入。 正确吗？ 
4.转换速率对相位噪声性能有多大影响？ 

请提前感谢。 
此致。 

Matteo Ricci

3 年多前

0 admin 3 年多前

TI__Guru**** 2399305 points

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您好，Matteo，

改善基准物相噪声的策略几乎始终是最大转换率的策略，直至基准噪声无法改善或 PLL 噪声占主导地位。

通常，差分信号总是比单端信号更好(如果可能)。通过典型的打捆机转换为设备附近差分的单端信号将从相对于每针振幅减小的 OSCin 转换率的增加(除非打捆机插入损耗超过3dB)中受益匪浅。全差分信号也将具有更好的共模噪声抑制的优势；如果参考迹线短路或屏蔽正确，这在许多设计中可能不是问题。
LVDS 或 LVPECL 等脉冲波的转换速率通常比同类正弦波要好。正弦波转换速率最大值由 SR = 2π*f*Vpk 提供，而脉冲波转换速率通常可以与信号频率和振幅分离。请注意，如果使用双倍加载器，OSCin 占空比应为50%。
正确，差速回转速率通常高于同类单端回转速率。如果100MHz 正弦波为5dBm，则该波约为0.562Vpk 至50Ω Ω，并转换为0.35V/ns 的单端切换率。假设接近理想的打捆，每个输出的振幅将减少3dB，并将大约0.4 Vpk 变为50Ω Ω。这意味着转换为0.25V/ns 的转换速率，但在两个 OSCin 引脚上，组合转换速率为0.5V/ns。因此，对于无损平衡，每引脚的振幅被 sqrt (2)系数减小，但总体转换率被 sqrt (2)系数提高。

有例外。平方波分解为一个基本的和多个奇怪的较高顺序谐波；如果不包括 LVDS 或 LVPECL 等脉冲波形上高转换率所需的多个谐波，则实际可能会降低总体转换率。但大多数情况下，这些脉冲波形格式将从完全不同开始。但这偶尔会伴随单端 LVCMOS 而来。
我没有确切的数字给你。从传闻看，这有助于达到至少0.5V/ns 的转换率。在100MHz 时，8dBm 单端或5dBm 变为平衡，是可接受转换率的良好基线。对于一个真正神奇的参考，由于接近噪声受 PLL 1/f 限制，且远端噪声由环路滤波器发出，因此上升的转换率会大大降低。对于质量较低的参考，参考封闭噪声本身可能成为限制因素，转换率的提高不会改变参考的基本封闭特性。我的观点是，尽可能优化雪橇速率，但不要不惜一切代价优化雪橇速率，因为以上优点可能是 LVDS 或 LVPECL 雪橇速率偏小。

此致，

德里克·佩恩

时钟和时序（参考译文帖）

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