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[参考译文] LMK05028:DPLL2未锁定相位。 它已锁定频率

Guru**** 2511985 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1086119/lmk05028-dpll2-is-not-phase-locked-it-is-frequency-locked

部件号:LMK05028

您好,起亚

那么,测量相位锁定(带范围)的正确方法是什么? 我尝试测量 IN0输入和 XO 输入的输出信号。 它们未锁定相位。 只有输出被锁相(当我查看好的设备时)。

我认为,芯片输入的其中一个可能是与输出相结合,可以观察到,但可能过于简单化的期望。

谢谢,

蒂姆

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你好,蒂姆。

    要在输入和输出之间实现相位锁定,您需要启用 ZDM (零延迟模式)。 要启用 ZDM,请设置 DPL1_ZDM_EN HIGH 和/或 DPL2_ZDM_EN HIGH,如下所示。 选择需要 ZDM 的输出,如下所示。

    一旦输入和其中一个输出之间有 ZDM,就可以同步输出,从而在输入和所有输出之间实现同步。

    要同步输出,请启用 CHX_SYNCEN

    启用 ZDM 并设置所有同步位后,切换(打开然后关闭) SYNC_SW  位,您的时钟将同步。

    此致,

    起亚·拉赫巴尔