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[参考译文] LMX2581EVM:输入参考和输出之间的相移

Guru**** 2535750 points
Other Parts Discussed in Thread: LMX2581EVM, LMX2581, CODELOADER

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/568466/lmx2581evm-phase-shift-between-input-reference-and-output

部件号:LMX2581EVM
主题中讨论的其他部件: LMX2581CODELOADER

尊敬的专家:

我的客户正在测试LMX2581EVM。

他确认了输入参考和输出之间的相位转换。

相移不是常量值,此时的值不同。

请查看三个附加文件。

(1)这种现象是否正常?

(2)如果是,最大相移是多少?

(3)为什么会发生相位转换?

他想要设计一个完美的同步正时电路,他必须知道具体的相移量。

我非常感谢您的帮助。

此致,

信一

 

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    信一

    只要涉及部门,就可以创建相位移。  例如,如果您除以2,则有两个相位可能相隔180度。  

    LMX2581在VCO之后有一个分频器,这会产生随机相移。   这也可能来自R分压器。

    有 一种零延迟模式,可用于将VCO分压器置于反馈路径中以使用或零延迟

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    亲爱的Dean:

    感谢您的回复。

    我知道可以创建相位转换。

    因此,我让客户使用零延迟模式,并参阅8.3 Tm10 0–延迟模式的数据表P.20。

    感谢您的巨大帮助。

    此致,

    信一

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     亲爱的Dean

    客户尝试零延迟模式,但结果不理想。

    当他使用零延迟模式时,相移不稳定。

    如果零延迟模式关闭,相移稳定。(该值取决于开机时间)

    请参阅随附的文件。
    您可以看到144MHz (绿线)与12MHz基准相比不稳定。

    设置后面是数据表。

    程序
    1.如果N不能被VCO_DIV整除,则降低相位检测器频率以使其整除。
    ※请参阅编码器设置,N=168为可分割VCO_DIV 14,这不是问题。

    2.正常编程并锁定PLL。
    ※它像往常一样编程。

    3.对NO_FCAL =1进行编程。
    ※在Codeloader上选中NO_FCAL。

    4.程序0_DLY = 1。 这将导致PLL失去锁定。
    在Codeloader上选中※Codeloader上でIt zero_delay。

    5.使用PLL_N*/ VCO_DIV对PLL_N值进行编程,其中PLL_N*为原始值。
    ※他认为如果在程序1中N不可分割VCO_DIV,则执行该命令。

    6. PLL现在应锁定在零延迟模式。

    请问您有什么问题吗?

    感谢您的巨大帮助。

    此致,

    信一

    e2e.ti.com/.../Codeloader.pdf

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    亲爱的Dean

    情况如何?

    我想回答客户的问题。

    您能告诉他该怎么做吗?

    感谢您的巨大帮助。

    此致,

    信一

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    新一山

    我从客户设置中看到以下内容

    Fosc=12MHz

    FPD=12MHz

    Fvco=2016 MHz

    PLL_N = 168

    因此,要锁定此功能,客户可以正常锁定。  然后设置NO_FCAL=1。  然后启用零延迟模式。  然后设置PLL_N=12,这意味着VCO频率在Codeloader中看起来像144 MHz,并且会显示为红色,尽管这是正确的。  然后,它应锁定。  您是否正在编程PLL_N=12?

    此致,

    Dean

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    亲爱的Dean

    感谢您的回复。

    我知道最后的PLL_N编程是必要的。

    我将向客户发送您的建议。

    感谢您的巨大帮助。

    此致,

    信一