[参考译文] CDCM6208：PDN=HIGH 时 SPI 通信的任何等待时间限制

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1120599/cdcm6208-any-limitation-for-wait-time-for-spi-communication-when-the-pdn-high

器件型号：CDCM6208

大家好、团队、

我对加电时的接口可用时序有疑问。
我们使用手动 PDN 操作、在 VDD 稳定后、对于 PDN、它为高电平。
当 PDN=HIGH 时、我们使用通过 SPI 配置寄存器、PDN 启动 SPI 通信的等待时间是否有限制？
我认为、如果 PDN=低电平将变为内部 LDO 禁用、则需要等待时间来为 REG_CAP 充电。

此致、

Sato

3 年多前

0 admin 3 年多前

TI__Guru**** 2511415 points

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尊敬的 Sato：

我明天将对此进行研究。

此致、

Jennifer

0 admin 3 年多前

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尊敬的 Sato：

一旦 PDN 被拉至高电平且 VDD 电源稳定、就可以进行 SPI 通信。

编辑：是的、您需要在 PDN=1且 VDD 电源稳定后等待大约1ms、然后才能进行 SPI 通信。

此致、

Jennifer

0 admin 3 年多前

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您好、Jennifer、

感谢您回答我们的问题。

此致、

Sato

时钟和时序（参考译文帖）

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