[参考译文] LMK04826：4个 ADS52J90 AFE 的 CLK 和 Intel Arria 10

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/904040/lmk04826-clk-for-4-ads52j90-afcs-and-intel-arria-10

器件型号：LMK04826
主题中讨论的其他器件：CLOCKDESIGNOL、 ADS52J90、 LMK04821、 ADS52J90EVM、 LMK04832

您好！

我正在使用4 个 ADS52J90 和 Intel Arria 10 FPGA 进行设计。 ADS52J90 在我们的设置中需要40MHz 时钟、Intel JESD204B IP 块需要160MHz。我们不能使用 sysref 在设备之间进行同步。使用 clockdesigntool、我无法使此配置正常工作。

这些时钟是否可以使用 ADS52J90 EVM 上使用的 LMK04286来制作？我想使用此器件来重复使用为 Devkit 开发的软件。

在我们的设置中使用的最佳输入时钟频率是多少？

此致、

米歇尔·沃特斯

3 年多前

0 admin 3 年多前

TI__Guru**** 657930 points

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您好、Michel、

对拖延表示歉意。如果40MHz 是 ADS52J90的主时钟、并且 SYSREF 频率较低、则在没有外部 VCO 的情况下无法使用 LMK04826。这是因为最大时钟分频为32：40MHz * 32 = 1280MHz、而最小 VCO 频率为1840MHz。我还检查了 LMK04821 (具有用于降低 VCO 频率的后分频器、这是与 LMK04826唯一的寄存器差异)、但 LMK04821在160MHz 处有一个频率孔。

理论上、您可以使用具有10位分频器的 P2P 兼容型 LMK04832。使用 LMK04832、您可以将 VCO 频率设置为3200MHz、并除以20和80、以获得160MHz 和40MHz。遗憾的是、除了需要返工之外、还需要通过 TICS Pro 手动更新寄存器编程。如果我正确地回忆一下、为 ADS52J90EVM 构建的软件允许用户加载自己的固件、因此尽管 ADS52J90EVM GUI 可能无法显示正确的值、也无法用于实时更新大多数寄存器、您仍然可以通过首先使用 TICS Pro 生成固件映像来将固件映像加载到 LMK04832、ADS52J90EVM 软件生成的同步脉冲或 SYSREF 请求仍将得到与 LMK04826情况相同的处理。

关于输入频率的选择、您需要与 ADS52J90EVM 团队联系、以确定其针对 LMK04826情况的典型系统配置和同步过程、然后为 LMK04832生成类似的配置。 "最佳"输入频率取决于几个因素、包括可用的频率范围、是否使用零延迟模式以及 PLL1是否用作抖动清除器。如果您决定使用 LMK04832进行评估是可以接受的工作量、我稍后可以帮助您进行输入频率选择。

此致、

0 admin 3 年多前

TI__Guru**** 657930 points

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尊敬的 Derek：

获得正确时钟的唯一方法是切换到 LMK04832。那么、这就是我们要做的事情。您能为我们的用例为 LMK04832提供最佳配置吗？

此致、

米歇尔·沃特斯

0 admin 3 年多前

TI__Guru**** 657930 points

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您好、Michel、

我想确保我了解您打算做什么：您是使用我们自己的原理图和布局测试这一点、还是先重新设计 EVM 并在单器件情况下检查结果？

我简要回顾了 LMK04826的 ADS52J90EVM 配置文件、看起来 EVM GUI 软件在 LMK 使用方面有些不一致-在某些情况下、器件处于分配模式、在其他情况下、使用板载 PLL 和振荡器、但没有明确的理由来做出选择。 GUI 软件还会做出一些有问题的选择、包括在某些情况下、尽管将时钟置于分配模式、但仍使两个 PLL 处于活动状态、或者在 ADC 时钟附近的时钟上使 SYSREF 处于连续模式(这会在 SYSREF 频率上增加杂散)。除了 FPGA 同步时钟输出或发出 SYSREF 请求外、我不确定 ADS52J90EVM 软件有何优势。

您是否打算使用 LMK04832 PLL、还是仅使用分配模式？用于比较：

在分配模式下、该器件只是用作具有 SYSREF 生成功能的缓冲器/分频器。您需要的输入时钟是所有输出时钟的 LCM；如果您仅使用40MHz 和160MHz、则可以使用源自纯净振荡器或其他源的160MHz 时钟(或160MHz 的任何更高倍数)。但是、就价格或可用性而言、160MHz 可能不是振荡器的有用值。
PLL2处于活动状态的干净100MHz 振荡器足以生成所需的160MHz 和40MHz 输出时钟。 PLL2的 VCO 将设置为3200MHz。可以想象、还有其他输入频率选择、但它们可能很昂贵或很少见；100MHz 是许多供应商提供的一种简单且储备充足的值。
您还可以使用级联到 PLL2中的 PLL1、但这只有在您需要通过一些低频或一些不方便的3200MHz 商进行外部频率控制时才有意义。听起来您不需要这个。

此致、

0 admin 3 年多前

TI__Guru**** 657930 points

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尊敬的 Derek：

我们有一个 EVM、正在使用它来查看我们是否可以使用单通道案例启动和运行项目。我们还具有一个包含 FPGA 的 EVM、并正在为此开发 VHDL、以启动和运行器件。因此、我们不会在最终设计中使用 EVM 软件。让我们忘记使用 EVM、然后使用我们自己的原理图和布局来重点了解我们的最终产品。这是我之前提到的4个 ADC 和1个 FPGA 的用例。我们将通过 SPI 接口使用 FPGA 对 LMK 器件的设置进行编程。

我更喜欢您提出的第二个建议：

PLL2处于活动状态的干净100MHz 振荡器足以生成所需的160MHz 和40MHz 输出时钟。 PLL2的 VCO 将设置为3200MHz。可以想象、还有其他输入频率选择、但它们可能很昂贵或很少见；100MHz 是许多供应商提供的一种简单且储备充足的值。

我们希望使用脉冲 SYSREF、因为我们不希望系统中 SYSREF 的杂散。 PLL1可被关闭。

对于 LMK04832的其余配置、我应该注意哪些缺陷？

此致、

米歇尔·沃特斯

0 admin 3 年多前

TI__Guru**** 657930 points

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您好、Michel、

[引用 USER="Michel Wouters"]这样我们就不会在最终设计中使用 EVM 软件。

请记住、您可能会使用适用于 LMK04832的 TICS Pro EVM 软件来创建配置。然后、您可以将其导出为.txt 文件、以获取您的 FPGA 将编程的原始寄存器。

此外、根据数据表第8.3.3节、其中讨论了启用 SYSREF 的正确过程、LMK04832 GUI 具有一个"频率规划器"选项卡。频率规划器选项卡不仅仅是频率规划器、因为它还有助于配置常规器件模式和 SYSREF 等内容。

它利用"设置模式和 SYSREF"页面上的一些按钮来执行此操作。
我能想到的最大问题是这个过程...
- 您不能对单个寄存器映射进行一次编程、并使器件完全配置。
- 为方便起见、在该频率规划器选项卡的底部、最后一步是一个按钮、用于生成寄存器序列以执行本节8.3.3。同步所有分频器并返回所需的工作模式、即 SYSREF 脉冲发生器。

既然您已经知道了您要采用的路由、具有100MHz OSCin 参考的单个 PLL、请查看 LMK04832 GUI 中的频率规划器/器件配置、看看这是否有助于为您配置器件。它还应优化输出分配、以用于串扰。

如果软件给您带来任何问题、或者您有任何改进频率规划器的建议、请告诉我。
-我确实注意到在输入参考中、时钟类型并不是很清楚。 MOS 用于 CLKIN 上的 LVCMOS 输入。否则、您可以选择双极。 (实际上没有 OSCin 输入选项)。

另一个需要记住的注意事项：CLKin0具有双用途同步输入、CLKin1具有双用途作为分配输入、CLKin2具有双用途作为 OSCout。所有这些都可以用作具有较小带内相位噪声冲击(内存小于或等于0.5 dB？)的 PLL2的基准与 OSCin 的关系。

73、
Timothy

时钟和时序（参考译文帖）

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