[参考译文] CLK 同步输出

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Other Parts Discussed in Thread: LMX2492, LMX2491, LMK04828, LMK04832, LMK04826

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/951761/clk-synchronization-output

主题中讨论的其他器件：LMX2492、 LMX2491、 LMK04828、 LMK04832、 LMK04826

我们在100us，内具有300MHz 至600MHz 的 FM 时钟信号线性调频脉冲、我们希望使用一个延迟器件、该器件可以使其延迟从0到3.3ns，更好地使用电压来控制此延迟。我们发现 PLL 可以使其产生多通道输出并可以调整其相位。是否有任何 PLL 芯片可以实现它、并且具有越来越多的通道输出、这些通道输出具有可调节延迟？

4 年多前

0 admin 4 年多前

TI__Guru**** 2394295 points

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您好！

LMX2491和 LMX2492是可生成线性调频脉冲的两个器件。这些器件没有任何内置延迟。

我们确实有一些具有可编程延迟的缓冲器、这是否值得关注？要调整相位、您可能需要在分配模式下使用网络同步器(例如 LMK04828、LMK04832)。

谢谢、

Vibhu

0 admin 4 年多前

TI__Guru**** 2394295 points

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我找到了 LMK04826& LMK04828的方框图。如果我们使用 VCO 生成2GHz 信号、并且我们的线性调频脉冲信号(300MHz-600MHz)连接到 CLKin0、我可以获得14个线性调频脉冲 SDCLKout 吗？ SDCLKout 的最小数字延迟是?

0 admin 4 年多前

TI__Guru**** 2394295 points

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你(们)好。

让我澄清一下要求。

100µs 时钟：在300MHz 和600MHz 之间以 μ s 为单位进行扫描的线性调频脉冲信号

输出时钟：14份输入时钟、具有高达3.3ns 的可调节输入/输出传播延迟

输出时钟格式：单端 CMOS/Differential？

我们没有适合这一要求的完美匹配器件、您可以尝试 LMK01xxx 系列时钟缓冲器。但是、我不确定它是否适用于线性调频脉冲信号。

LMK048xx 器件可提供更多的输出、但模拟延迟小于1ns。您不能使用数字延迟、因为器件将在缓冲模式下使用。

0 admin 4 年多前

TI__Guru**** 2394295 points

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输出时钟格式：单端 CMOS/差动正常、如果采用单端格式则更好

2.LMK048xx 的？延迟小于1ns.can 模拟延迟将数字延迟相加？、如果我为 LMK048XX 提供线性调频脉冲信号，、对于2GHz 内部 VCO、数字延迟最小仍为500ps

0 admin 4 年多前

TI__Guru**** 2394295 points

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您好！

LMK0482xB 系列没有14x LVCMOS 输出。它具有14个仅差分输出。

LMK04832还具有14个差分输出、其中9个输出对可配置为 LVCMOS 模式。在 LVCMOS 模式下、这9个差分输出可用作18个 LVCMOS 单端输出。来自同一差分输出引脚的 CMOS 输出可配置为处于同一相位或异相。

是的、可以添加模拟和数字延迟、但 LMK04832仅具有数字延迟。最大数字延迟可以是1023个时钟周期。

LMK0482xB 系列具有模拟和数字延迟、但数字延迟最多可为32个 VCO 周期。

谢谢、

Vibhu

时钟和时序（参考译文帖）

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[参考译文] CLK 同步输出