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[参考译文] 无集成 VCO 设计寄存器的单环路 PLL

Guru**** 1144270 points
Other Parts Discussed in Thread: LMK05028, CDCM7005, LMX2485E
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1168212/single-loop-pll-without-integrated-vco-design-reg

主题中讨论的其他器件:LMK05028CDCM7005LMX2485E

尊敬的团队:

大家好、我对高 稳定性10MHz 时钟源的相位锁定100MHz OCXO 输出(-130dBc@100Hz)有要求。

我在查看以下器件、

LMK05028

CDCM7005

您能不能告诉我我是否可以使用上述部件或任何替代部件。 此类实现的连接和测得的输出相位噪声是多少?

如果您可以与 PLL 共享用于对 OCXO 进行相位锁定的任何应用手册或设计、将会非常有帮助。

谢谢、此致、

Deva

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Deva:

    我想您可以简单地使用 LMX2485E 等 PLL 来锁定 OCXO。 您需要使环路滤波器带宽小于50Hz、以便100Hz 时的相位噪声不会受到影响。 建议使用有源环路滤波器、以消除由于 OCXO 的频率调节引脚而导致电荷泵泄漏的可能性。  

    要设计环路滤波器、您可以使用 PLL SIM (www.ti.com/.../PLLATINUMSIM-SW)。