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[参考译文] LMK04832EVM:无法设置 LMK04832在双环路模式下运行

Guru**** 2380960 points
Other Parts Discussed in Thread: LMK04832
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/833011/lmk04832evm-can-not-setup-lmk04832-operate-in-dual-loop-mode

器件型号:LMK04832EVM
主题中讨论的其他器件:LMK04832

尊敬的先生! 我在电路板中使用 LMK04832器件、需要将其配置为在双环路模式下运行。 但我无法获得 PLL2 DLD (Status_LD2)锁定。 当我尝试在单环路模式下使用时、 PLL2 DLD (Status_LD2)被锁定、并且我获得了正确的输出频率。 请查看我的设置并给我一些建议! 谢谢!  

e2e.ti.com/.../LMK04832_5F00_single_5F00_PLL2.tcs

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    以下是我在双环路模式下对 LMK04832的设置:

    e2e.ti.com/.../LMK04832_5F00_dual_5F00_loop_5F00_mode.tcs

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    尊敬的 Duc:

    这些 TCS 文件之间的唯一区别是 PLL2_RCLK_MUX 的状态。 由于 PLL2在以 CLKin1为基准时表示锁定、但在以 OSCin 为基准时表示未锁定、因此表明问题出在 PLL1或 VCXO。 PLL1是否在双环路配置中锁定?

    此致、

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    您好! 感谢您的回复! 是的、我认为问题是 PLL1或 VCXO。 但在我的电路板中、没有 PLL1锁定指示灯(LED)、因此我无法检查 PLL1的锁定情况。 我测量了 VCXO (122.88MHz)和引脚+VDD (+3.3V)的引脚 RF_OUT。 现在我不知道尝试。 您能否查看我的 LMK04832原理图并为我提供建议、请!  我想一下引脚复位/GPO (在我的板中、该引脚下拉至 GND)、并且引脚同步是悬空的(因为我不需要同步多个 LMK04832)

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    尊敬的 Duc:

    您似乎有一个针对 LMK LD2的连接。 为了进行调试、您可以将 PLL2_LD_MUX 寄存器的值更改为输出 PLL1 DLD、并确认 PLL1是否锁定。

    在原理图中、我注意到 OSCin_N 端子直接接地。 与单端 CLKinX 引脚一样、在驱动单端时、OSCIN_N 应通过一个0.1µF μ F 电容器连接到 GND、以保持共模偏置。 OSCin 输入上的一个问题会解释您描述的行为(PLL2在将 CLKin1用作输入时锁定、但在将 OSCin 用作输入时不会锁定)。 话虽如此、在进行此修改之前、请先检查 PLL1是否锁定。 如果 PLL1在 OSCin_N 直接连接到 GND 的情况下锁定、我们需要考虑其他解释。

    此致、

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    是的、我将 PLL2_LD_MUX 寄存器更改为 PLL1 DLD 和 PLL1、直到未锁定。 但是、当我使用 OSCin 作为单个 PLL2的输入时、我看到 PLL2被锁定(但不稳定、指示灯点亮和熄灭)。 以下是我的新设置:

    e2e.ti.com/.../LMK24M576_5F00_input_5F00_single_5F00_PLL2.tcs

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    尊敬的 Duc:

    如果在信号也直接馈送到 OSCin 的情况下、PLL2无法获得稳定锁定、则表明它是直接接地的 OSCin_N 引脚。 请更新 OSCIN_N、改为通过一个0.1µF μ F 电容器接地。

    此致、