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[参考译文] LMK04616:RESETN 恢复时间

Guru**** 2390785 points
Other Parts Discussed in Thread: LMK04616

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/783227/lmk04616-resetn-recovery-time

器件型号:LMK04616

我们在单级配置中使用 LMK04616 (绕过第一级)。  我们发现,在初始化步骤期间,必须增加100ms 的延迟,才能使设备正常工作,我们想知道是否需要这样做。

初始化序列的第一部分如下所示。  必须在步骤3之后和步骤11之前的任何位置发生100ms 延迟。  当延迟被消除或减少或置于这些步长之外时、器件不会锁定、输出频率不正确。  我们还尝试在步骤3和 11之间插入多个较小的延迟、只要总延迟至少为100ms、器件就能正常工作。

RESETN 有效(低电平有效)时间为~400ns、对器件的每次 SPI 写入花费~3us。

1:  将 RESETN 引脚驱动为高电平
2:  将 RESETN 引脚驱动为低电平
3:  将 RESETN 引脚驱动为高电平
                            <=此处之间增加了100ms 的延迟...
4:  将0x80写入0x08D
5:  将0x00写入0x011
6:  将0x0E 写入0x010  
7:  将0x04写入0x012
8:  将0x00写入0x013
9:  将0x00写入0x014
10: 将0x08写入0x015
                            <=...这里
11: 将0x48写入0x016



199:将0x01写入0x011

谢谢、
Justin

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    您好 Justin、

    我想您在释放 RESETN 之前确认所有电源均已通电?

    通过查看图50中的流程图、可以了解内部 LDO 稳定时间。 您能否确认 PLL1_CAP、PLL2_LDO_CAP 和 PLL2_VCO_LDO_CAP 在开始编程之前处于最终电压? 或者、如果在编程期间发生这种变化、那么延迟会导致电压达到最终电压?

    73、
    Timothy
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    谢谢、Timothy。

    LMK 连接到 FPGA。 RESETN 在上电期间上拉(失效)、一旦 FPGA 进行配置、它就会将 RESETN 驱动为低电平。 在执行上述初始化步骤之前、我们可能会保持此状态几秒钟或几分钟。 如果我们在不循环通电的情况下重复初始化、我们将获得相同的行为。

    我将在 RESETN 上放置一个下拉电阻器、看看这是否有用。 我还将探测电容引脚以验证它们是否已稳定。

    Justin
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    我们向 RESETN 添加了10K 下拉电阻、以在上电期间和加电后将器件保持在复位状态。  配置后、FPGA 继续驱动 RESETN = 0V。  我们将保持该状态几秒钟。  所有电压和时钟输入看起来都很好。  但是、在前7个事务中的某个位置释放复位后、我们仍然必须添加100ms 延迟、才能正确启动器件。

    在我看来、这与 RESETN 何时发布有关。  是否详细描述了 RESETN 所控制的内容以及发布后会发生什么?  如果器件具有 POR 电路、为什么还需要将外部 RESETN 置为有效?

    Justin

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    1、测量 RESETN 引脚波形以确认上升沿不会太慢至100ms。 移除 RESETN 引脚上的大电容。
    2、为了实现器件正常运行、TI 建议按数字顺序对寄存器进行编程、例如0x000至0x1FFF。
    TICS Pro 可以导出十六进制寄存器文件、其中显示了寄存器编程序列。 可以忽略保留的寄存器。
    4:将0x80写入0x08D //仅执行写操作,切勿介意3线或4线 SPI,此步骤可忽略,直到您需要读取寄存器。
    5:将0x00写入0x011 //默认值、自清零位、删除此步骤
    3、确保 SPI 时钟< 20MHz、高宽度和低宽度> 25ns。