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[参考译文] LMK04832：为什么在将内部 VCO1设置为3440.64MHz 时 PLL 锁定(在 PLL1断电模式下)

admin
Guru**** 2554780 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/853185/lmk04832-why-pll2-locked-when-setting-internal-vco1-to-3440-64mhz-under-pll1-power-down

器件型号：LMK04832

您好！

我尝试过使用 PLL1进行多项设置、但 PLL1从未锁定。

现在、我为 PLL1断电、只使用 PLL2。 我针对 VCO1测试了2949.12MHz、3194.88MHz 和3440.64MHz。

且仅当 VCO1设置为3440.64MHz (N DIVIDER = 14)时才会锁定 PLL2。

但根据规格、VCO1应在2945至3255MHz 范围内。

发生这种情况有什么原因吗？ 是否有人建议将 PLL2锁定在 VCO1=2949.12MHz 且带 PLL1的情况下？  

谢谢你。

LMK04832_VCO1_3440MHZ.TCS

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    TI__Guru**** 2554780 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好！  

    只要其他参数在规格范围内、VCO 就能够在指定范围内锁定。

    您能否提供有关测试条件的更多详细信息？

    您使用的是 TI EVM 还是您自己的 PCB 设计？

    谢谢、

  • 0
    TI__Guru**** 2554780 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    我们的电路就像该链接中的原理图一样。 (https://e2e.ti.com/cfs-file/__key/communityserver-discussions-components-files/48/mach_5F00_LMK04832.png)

    我们在用于 PLL2的 OSCin 上放置了一个122.88MHz VCXO。 CLKin0、1、2上无输入。 OSCout 缓冲器断电。

    我们将输出信号探查到示波器上(500MHz、 最大4.5GSPS)、以查看我们是否获得精确的时钟。

    在这种情况下、R 和 N (以及预分频器)分频器只是使 PLL2锁定的参数。

    在我们的测试中、当 R =1、N=14、并且预分频器=2时、它被锁定。 (指示灯 LED 亮起)

    但是、如果 OSCin = 122.88MHz、使用这些参数值、VCO1将为3440.64MHz (来自 TICO 专业版)、超出规范规定的范围(2945至3255MHz)。

    如何解决以确保 VCO1在该范围内？

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    TI__Guru**** 2554780 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    新山

    VCO 频率需要是122.88MHz 的倍数。

    我计算 VCO 频率的以下可能性：

    2457.6MHz

    2949.12 MHz

    3072 MHz

    3194.88 MHz

    此致、

    Dean