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[参考译文] CDCE62002：关于数据表中的时序要求

admin
Guru**** 2526170 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/778346/cdce62002-about-timing-requirements-in-the-datasheet

器件型号：CDCE62002

您好！

数据表中描述了两个参数、如下所示。

我认为这些参数显示的频率相同、但有两种表示法"fREF-差分输入 DIV"和"fREF-差分参考- DIV"。

哪一个是正确的？

应用于预分频器或基准分频器的频率是什么模块？

谢谢你

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    TI__Guru**** 2526170 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    两个参数都正确。 最大规格"fREF-差分 REF- DIV"是"fREF-差分输入- DIV"的一半、因为预分频器设置为1而不是2。
    输入分压器可由数据表表表5确定。

    此致、
    通道

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    TI__Guru**** 2526170 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    我很困惑。  我需要从297MHz 到148.5MHz 的频率转换。 但是、PLL 不能使用频率规划器生成的参数进行锁定。

    请参阅以下文件。 我希望您确保分频器的规格。

    /cfs-file/__key/communityserver-discussions-components-files/48/Maximum-Divider-Frequency.pdf

    此致。

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    TI__Guru**** 2526170 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Masaaki-San、您好！

    如 Lane 所示、数据表中的分压器规格似乎正确。

    但是、EVM 工具未正确对分频器进行编程。
    (1)第一个分频器必须设置为/2、以满足分频器频率规格和
    (2)该器件的最大相位检测器频率为40MHz、如规范 fCPmax 所示、因此当297MHz 直接进入 PLL 时、它将无法锁定。

    计算显示正确的相位检测器频率后、频率规划器会出现、但应用解决方案后、它不会更新分频值。 感谢您将此错误提请我们注意。

    在您的编程中、请进行调整以将预分频器编程为/2 (R0、位9 = 1)。

    73、
    Timothy