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[参考译文] LMK04803：LOS 状态

admin
Guru**** 2388460 points
Other Parts Discussed in Thread: LMK04803
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/712211/lmk04803-los-status

器件型号：LMK04803

你(们)好

LMK04803的两个时钟输入(CLKinx)被连接至时钟源。 一个连接到板载振荡器、另一个连接到外部源。 STATUS_CLKinx 引脚配置为 输出 LOS 状态。 在外部源断开连接的情况下、该时钟的 LOS 状态无效。 LOS_TIMEOUT 设置为最大值1200ns。 寄存器设置如下：

0x1B0C01AC、 /* R12. *
0x2313120D、 /* R13. *
0x130FC00E、 /* R14. *

我能够 使用 Status_CLKinx_MUX 和 Status_CLKinx_TYPE 寄存器设置来切换 STATUS_CLKinx 引脚。

提前感谢 Edward

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    TI__Guru**** 2388460 points
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    尝试设置 CLKinX_BUF_TYPE = 1 (MOS 模式)。  当交流耦合时、输入缓冲器应该为 MOS 模式以获得差分输入失调电压(典型值~55mV)、从而防止噪声复位 LOS 检测器电路。   

    Alan

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    TI__Guru**** 2388460 points
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    感谢您的信息 Alan。

    我更改了 R14以将两种缓冲器类型都设置为 CMOS (0x133FC00E)、但状态引脚值没有改变。 LMK 由 LVDS 驱动器驱动、该接口与数据表中描述的差分时钟接口一致。 应将基于接口设计的噪声降至最低。
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    TI__Guru**** 2388460 points
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    您的接口设置是否与数据表中的图21或图26类似？

    Alan
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    抱歉、交流耦合。 根据图21进行设置。 相同的组件值。 由 SN65LVDS1DBVR 驱动

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    TI__Guru**** 2388460 points
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    当输入配置为 MOS 模式与双极模式时、您在 CLKinx+和 CLKinx-引脚之间测量什么输入失调电压？ 在未驱动输入时钟时、您是否在这些引脚上探测到信号、以确认没有信号/噪声可能会被输入级增益、并可能在输入 LOS 检测器达到超时计数之前将其复位？

    Alan
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    TI__Guru**** 2388460 points
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    很抱歉耽误您的回答。 我正在等待电路板设计人员进行测量。 两者的偏移很小、PP 噪声约为10mV。  附加屏幕快照。

    第一个是 CMOS

     

    第二个是双极。

    这个神秘的问题可能会得到解决。 通过切换时钟源、我发现 LOS 仅对所选时钟有效、因此当手动选择 CLKin1 (未使用保持)时、CLKin0的 LOS (未连接外部时钟)不会有效。 当我切换到 CLKin0时、LOS 被置为有效。 在 STATUS_CLKinx 输出上查看 LOSx。 我的原始描述不完整、但我希望无论选择哪个时钟源、状态都处于活动状态。

    我们要寻找的问题是、在我们的一个生产板上、我们无法获得 LD 来指示 PLL1的 DLD、即使我们看不到 CLKin1的 LOS 被置为有效

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    TI__Guru**** 2388460 points
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    感谢您的更新。 我相信 LOS 会反映在您手动选择的时钟输入中、正如您所看到的。 我将确认这一点并告知您。

    Alan
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    TI__Guru**** 2388460 points
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    谢谢 Alan