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[参考译文] LMK03328:输出频率同步

Guru**** 663810 points
Other Parts Discussed in Thread: LMK03328
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1222570/lmk03328-output-freq-synchronization

器件型号:LMK03328

您好、团队成员:

我的客户正在使用 LMK03328、但当他们更改输出频率值时会出现问题。

如果它们更改了输出6和7的频率、两个输出都不同步

您能告诉我们、哪种寄存器设置可以解决此问题吗?

此致、

奥斯汀

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    您好、Austin:

    应可通过 GPIO 引脚或寄存器12.6手动触发输出同步功能、从而重新同步输出、请参阅 LMK03328数据表的第10.4.17节。

    此致!

    Evan Su

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    您好、Evan:

    感谢您的回复。

    似乎需要最小 SYNCN 宽度作为数据表。 如果客户违反了这一点、会发生什么情况?

    我不完全了解图69。  

    SYNCN 的上升沿应在参考时钟的第4个边沿之前的一个时钟周期内。 这是否正确?

    此致、

    奥斯汀

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    您好、Austin:

    如果不满足最短 SYNCN 时间、一些输出分频器可能无法正确复位、同步将不会成功。 我也不太明白图69、因此我会与我的团队进行核实、让您知道。

    此致!

    Evan Su

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    您好、Austin:

    我获悉图69是指如果 SYNCN 的上升沿发生在当前 PLL 时钟周期周围的窗口处(本例中为时钟周期#3)、则重新启动输出缓冲区的过程将在下一个 上升沿启动 (在此示例中、时钟周期#4的上升沿)。 我认为、只要您需要、您就可以保持 SYNCN、并不一定需要在参考时钟的第4个边沿之前有1个时钟周期。

    此致!

    Evan Su