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[参考译文] LMX2694-3G:输出 EP 信号中有许多杂散

Guru**** 1107330 points
Other Parts Discussed in Thread: PLLATINUMSIM-SW
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1272665/lmx2694-ep-there-are-many-spurs-in-the-output-4-3g-signal

器件型号:LMX2694-LMX2694 EP
主题中讨论的其他器件: PLLATINUMSIM-SW

大家好、

测试500-6000M 频带的输出时、在部分频带信号的近端发现了使用 LMX2694-LMX2694-Q1 EP 芯片输出信号的杂散。 例如、在4300MHz 处、杂散最接近主信号。 客户查看数据后发现它好像是 PLL 的整数边界杂散,即相位频率及其谐波和输出信号杂散,如112.88*35-4300=0.8m。 减小电荷泵电流可改善杂散、但最好将其保持在70dBc 以下。 根据上述计算,最大杂散应约为122.88*n。  

下图显示了4300M 输出信号频谱:  

在4300M 时、配置如下:

您能帮助了解这种情况吗? 谢谢。

谢谢。此致、

切里

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    樱桃、

    杂散可能由输入(Fosc)和 VCO 与输出(Fvco 和 Fout)的混合引起。  在这种情况下、杂散可能超出环路带宽、因此通过减小电荷泵电流、您将减小环路带宽。  但是、如果重新设计环路滤波器、则可以对其进行更好的优化。

    如果重新设计更低的环路带宽、这会有所帮助、但实际上使用更高阶(3阶或4阶)环路滤波器可能会有所帮助、并且这些杂散远远超出环路带宽。  我们的 PLLatinum Sim 工具(ti.com/tool/PLLATINUMSIM-SW)可为环路滤波器设计和杂散仿真提供帮助。   

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    Dean、您好!

    感谢您的支持。

    电流环路滤波器带宽为200kHz、此值在手册中进行了建议。 客户已使用 PLLatinum Sim 工具进行了仿真、环路带宽小于杂散。

    此外,在接近112.88*35=4300.8的频率上也有杂散。 频率点越接近4300.8M、杂散就越多。 例如、4300.85M 的第一个杂散为50kHz、4300.801M 的杂散为10kHz。 如果只是降低环路带宽、它将始终小于环路带宽。 请问是否有其他方法?

    下图显示了4300.85M 输出杂散频谱:

    谢谢。此致、

    切里

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    您好、Cherry:  

    EVM 在载波附近没有杂散:  

    我仅在0.80 MHz 处看到了预计会远离载波的杂散。  

    此致、  

    维森特  

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    您好、Vincente:

    您在4300M 时测试的0.8M 杂散与客户的测量值一致、如下所示:

    同时、客户针对杂散测量的功率很大、测试带宽设置为100 MHz。

    您能帮助分享输出4300.85M 处的 EVM 频谱吗? (相位反转频率为122.88 MHz、测试带宽为2 MHz)  

    谢谢。此致、

    切里

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    您好、Cherry:  
    以前我没有使用相同的频率。  
    我当时正在测试4300 MHz、因为这正是 RFout 在上面的代码段中显示的内容。

    测试4300.85 MHz 时、我看到载波附近的杂散。 您可以减小电荷泵以降低杂散振幅、但由于实施的频率、将无法消除杂散。  

    此致、  

    维森特