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[参考译文] CDCLVP111:LVPECL 终止偏置电压

Guru**** 2378760 points
Other Parts Discussed in Thread: CDCLVP111
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1377498/cdclvp111-lvpecl-termination-bias-voltage

器件型号:CDCLVP111

工具与软件:

您好!

我想获取 CDCLVP111建议的终端偏置电压的输入。

从应用报告 SLLA120 (LVPECL、VML、CML 和 LVDS 电平之间的接口)的图11和文献中(通常为 VCC–1.3V)应用作交流耦合的 LVPECL 终端偏置电压(VTERM)。  但是、从 CDCLVP111的数据表(图14)中可以看到、建议的端接偏置电压为2.5V * 105Ω/(105Ω+ 96Ω)≈1.3V、对应于(VCC–1.2V)。

我只是想了解、您对此有何意见或建议?

此致、

Francis

e2e.ti.com/.../Interfacing-Between-LVPECL_2C00_-VML_2C00_-CML_2C00_-and-LVDS-Levels_5F00_slla120.pdfe2e.ti.com/.../cdclvp111.pdf

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    您好!

    我明天会回到你身边。   

    此致、

    会的

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    Francis

    应用报告  SLLA120介绍了如何端接"如果接收器需要 LVPECL 信号电平、则3.3V 电源电压的共模电压约为2V "。   CDCLVP111不仅可以接受 LVPECL、还可以接受 LVDS、CML 和 SSTL 输入、因此数据表中的图14显示了如何专门为 CDCLVP111输入偏置输入。   

    总之、两种端接方案都可行、但 CDCLVP111数据表显示了其输入的理想配置、因此我建议使用这种配置。   

    此致、

    会的