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[参考译文] LMK04828:电源滤波和不同线对输出稳压器

Guru**** 1806570 points
Other Parts Discussed in Thread: LMK04828, TPS7A85, LMK04832
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1398606/lmk04828-power-supply-filtering-and-different-pair-outputs-reg

器件型号:LMK04828
主题中讨论的其他器件: TPS7A85LMK04832

您好!

我有以下有关 LMK04828的设计疑问、要求很严格、并且 VCO/任何杂散不能耦合到输出中。

1) VCC1-VCO 电源是否需要高 PSRR LDO、或者我是否可以连接到为 LMK 的所有 VCC 供电的公共电源(使用 TPS7A85源自)?(每个引脚使用铁氧体磁珠隔离)?

2) VCXO 是否也可以由为 LMK 的所有 VCC 供电的公共电源(使用 TPS7A85派生)供电、或者是否需要使用单独的 LDO (与 LMK VCC 电源网隔离)供电?

3)是否可以从不同的对中为 DAC 连接 DEV-CLK 和 SYSREF 并仍保持同步? 例如:DEV-CLK 来自 DCLKOUT4+、SYSREF 来自 SDCLKOUT7+

提前感谢、

Deva

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    Deva,

    1) 1)如数据表中所示、使用铁氧体磁珠隔离电源轨是我们建议的滤波策略。 数据表额定性能不需要单独的 LDO。 不过、为 VCO 电源添加单独的 LDO 可以进一步降低噪声。   

    2) 2)我们建议 对 VCXO 使用单独的 LDO。

    3)是的,你可以。


    如果您有任何其他问题、请告诉我、

    会的

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    您好!

    感谢您的答复、

    此外、还有一点、

    我是否可以使用 FPGA LVDS 标准(1.8V)通过 clkin0以差分方式提供同步信号直流耦合?

    在数据表中、仅针对 VIH >2V 的 MOS 类型提到了直流耦合规格、如果从 FPGA 1.8V 组连接、则无法实现该规格。 请告知。

    此外、LMK04828是否支持 R DIVIDER Reset 来实现同步?

    提前感谢、

    Deva

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    Deva,

    将是 ooo 的,并将回到你在一周的结束。

    此致!

    Andrea

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    Deva,

    感谢您的耐心。   

    是的、您可以使用直流耦合 1.8V LVDS 将同步信号驱动至 CLKin0。  确保将 CLKin1类型设置为 MOS。

    LMK04828不支持 R 分频器同步。  LMK04832支持  R 分频器同步。  

    此致、

    会的