[参考译文] LMK04832：SYSREF 作为 REF IN 或 FB

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

器件型号：LMK04832

工具与软件：

LMK04832支持两个 VCO、其范围为 VCO0 2440 ~ 2580 MHz 和 VCO1 2945 ~ 3255 MHz。

在 JESD204B 中、SYSREF 通常小于10MHz、并对器件时钟和采样时钟等具有一定的分频要求。

如何在 REF IN 的情况下设置单环路0延迟模式小于10MHz 或使用 SYSREF 作为 FB。

当 REF IN 或 FB 小于10MHz 时、VCO Cal 频率将与 VCO 频率不同。这正在导致错误。

我使用过 TICS Pro、但没有成功。

可行吗？谢谢你。

0 admin 8 个月前

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尊敬的 New2Day：
您能给我提供一个方框图/时钟树、说明您尝试在此处实施的产品吗？
在实现 ZDM 时、您将收到一条 PLL 状态消息、帮助您确定器件是否已锁定以及是否使用了不正确的分频器值。
以下面的为例：

由于 N 分频器为2 - N 分频器的输出为61.44MHz、因此 PLL2未锁定。
N 分频器必须设置为等于1。
如果设置为1、您将收到一条消息- PLL2已锁定。

此致、

Vicente

0 admin 8 个月前

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您好、Vicente：

我要在中配置 LMK04832 单环路0延迟模式。

根据器件时钟、器件时钟输出可以从100MHz 到400MHz、SYSREF 可以从1.25到7.8125 MHz。

我喜欢检查是否可以将 SYSREF 作为 REF CLK IN 或将 FB CLK 用于 N 分频器路径-根据 SNAA2019、这似乎是可以的。

如果可行、如何这样做。

如果这样做的话、我无法从 TICS Pro 获得 VCO 频率。谢谢你。

0 admin 8 个月前

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您好！

您提出的解决方案让我有点困惑。如果理解正确、就需要沿着分配路径对 SYSREF 信号重新计时、这是一种可行的解决方案。您到 CLKin0引脚的输入可以发送至 SYSREF_MUX、然后 SYSREF_MUX 可将其作为 SYSREF 信号进行分配。

可以将 SYSREF 用作 N 分频器路径的 FB CLK、但必须注意的是、您必须具有足够大的 SYSREF 频率以分频为 PFD 频率、或者您必须使用考虑 N 分频器输入的低 PFD 频率。这将导致串扰或相位噪声性能不佳。

此外、必须指出的是、SYSREF 信号仅在 SYNC 事件时输出。在这之前、如果您使用 SYSREF 作为 FB_MUX 的输入、您的 PLL 将失去锁定(即您将在运行开始时失去锁定)。

时钟树或功能方框图有助于提供任何进一步的帮助。

谢谢！

Michael

时钟和时序（参考译文帖）(Read Only)