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[参考译文] AFE5832LP:配置 PLL

Guru**** 2826855 points
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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1593349/afe5832lp-configure-pll

器件型号: AFE5832LP

主席先生/女士、

您能告诉我如何配置 AFE 5832 的 PLL、因为我发现器件的 32 个通道的输出数据同相未对齐。 您能给我举一个示例、为我配置一个或多个协议或代码吗? 非常感谢!

Qi  

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    您好、  

    TX_TRIG 信号可用于对齐 32 个通道的相位。 TX_TRIG 信号的频率应是 FS/2 的倍数

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    您能给我一个我应该遵循的协议或一些示例代码、它们应该能帮助我快速解决问题。 非常感谢。 Qi

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    HI、在按照数据表第 10.4 节中的建议在上电后初始化器件后、可以提供 TX_TRIG 信号、使 TX_TRIG 脉冲的宽度至少为 FS/2、其中 FS 是系统时钟。  

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    您好!请告诉我、在我为启动阶段配置了 PLL +TX_TRIG 后、应该如何避免 TX_TRIG 对 采样产生的相位影响? 在数据集中、我找到了“可以 使用 MASK_TX_TRIG“(使用 TX_TRIG 的 8.3.10.2 ADC 同步)来禁用 TX_TRIG 的相位复位、但数据表并未介绍如何执行此操作、而且 数据表中也没有 MASK_TX_TRIG。  

    非常感谢、

    Qi

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    MASK_TX_TRIG 位位于地址 46h、位<2>