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[参考译文] DAC7760:如何匹配高速ADC和低速DAC

Guru**** 664280 points
Other Parts Discussed in Thread: DAC7760, DAC7822, DAC8760
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/589945/dac7760-how-to-match-high-speed-adc-and-lower-speed-dac

部件号:DAC7760
主题中讨论的其他部件: DAC7822TIDA-0.017万TIDA-0.0119万DAC8760

为了适应输入信号频率,我必须选择更高速度的ADC,而另一方面,必须选择精密DAC以满足精度。 当DAC尚未完成转换时,ADC如何处理输入信号? MCU处理转换后的数据。 ADC是否重复转换并等待DAC? 有没有更好的解决方案?  

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    您好,Jingtai:

    根据ADC采样的速度,您可能会在切换至输出代码时测量DAC。  如果您尝试避免这种情况,则可以在DAC确定后使用DAC7760数据表上的设置时间规格将ADC与采样同步。  大多数ADC都可以配置为执行单个转换或连续转换。  

    如果您的问题得到了解答,请告诉我,

    谢谢!

    保罗

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    输入信号频率为10MHz,ADC采样频率至少为20MHz。 在MCU中进行处理后,DAC无法对其进行转换。 由于任意输入,ADC的采样速率不能减慢。 您是否知道其他解决方案?
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    另一种解决方案是选择高速DAC并权衡某些字符。 是否有输出0-10V和+/-10V的高速DAC?
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    京泰

    我认为我不理解这个应用程序是什么,您能否分享您所设想的结构图或原理图?

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    下面是一个结构图。 我必须从ADI上发布此图,因为TI没有此类方框图。

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    京泰

    根据图表,我认为您正在使用DAC来取消输入信号或用于放大信号的INAS的任何偏移或增益错误。  如果是这种情况,我认为错误的变化速度不会像ADC采样信号那样快。  在每100个ADC样本之后仅更新DAC是否合理?  可能是平均误差,而不是单次测量?

    如果确实需要>10MSPS,那么我会考虑使用带I到V放大电路的电流输出MDAC来达到所需的范围。  DAC7822 具有并行接口和大于20MSPS的更新速率,因此非常适合它。  DAC7822数据表中的图38显示了应用电路。

    您认为这些解决方案中的任何一种都适合您吗?

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    另一个限制别名错误。 因此,最低ADC采样频率为20MHz。  

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    关于DAC的+/-10V输出,但DAC的输出频率仅为1KHz,并且DAC  不必像ADC一样快速更新。 假设ADC采样速率为20MSPS,DAC可能会每 更新XXX个ADC采样。  

    你怎么看?

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    我认为这是一个好主意。  您可以查看稳定时间和转换速率规范,以确定运行DAC所需的最大更新速率。  

    如果您还有其他问题,请告诉我,

    谢谢!

    保罗

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    根据电气特性:对于0-10V输出,交流电压设置时间为22微秒,如果 客户需要的输出频率为1 KHz,则设置时间+转换速率时间= 0.1s,因此转换速率时间必须增加。 这是否正确?

    关于+/-10V输出,输出变化为20V? 电压设置时间是多久?

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    稳定时间规格已包括输出仍向最终电压输出回转的时间。  如果客户希望DAC的更新速率为1kHz,则应在下次更新之前很长时间确定输出。  因此,如果它们每隔1毫秒向DAC写入,则DAC将已结算。

    µs +/-10V范围,您可以使用相同的转换率值来估计稳定时间(0.5V/m Ω 时的20V步长为40µs Ω,加上~3-m Ω 用于小步长稳定) ,我认为总稳定时间值可以可靠地估计为5µs ~45µs Ω。

    谢谢!

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    感谢您的支持。
    关于方程式7:
    0-10V的LSB尺寸是多少? LSB的尺寸为+/-10V?

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    使用方程式1,我们可以通过以下方法计算10V范围内的LSB大小:

    VLSB = VREF *增益(1/2^12)

    VLSB = 5V * 2 (1/4096)

    VLSB = 2.441mV

    使用方程式2,我们可以通过计算+/- 10V范围的LSB大小,但我们需要减去两个不同代码处的输出以找到VLSB,例如代码0和代码1。  

    Vout (代码)= VREF *增益*(代码/2^12)-增益* VREF/2

    VLSB = VOUT (1)- VOUT (0)

    VLSB =(VREF *增益*(1/2^12)-增益* VREF /2)-(VREF *增益*(0/2^12)-增益* VREF /2)

    这些因素减少到:

    VLSB = VREF *增益*(1/4096)

    VLSB = 4.883mV

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    非常感谢!

    我对时钟有疑问。

    启动板中的SPICLK:

    3H (R/W)= SPI波特率= LSPCLK/4
    4小时(R/W)= SPI波特率= LSPCLK/5
    7Eh (R/W)= SPI波特率= LSPCLK/127
    7Fh (R/W)= SPI波特率= LSPCLK/128

    CPU的LSPCLK为200MHz。 最小SPCLK为200MHz/128。 写一个字节需要多少个时钟? 我尝试计算 SLCLK循环时间和切换时间 以满足1 KHz输出。  您能根据您的知识帮助我吗?

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    数据表指定的最大通信速度为30MHz,或每时钟周期约为33ns。  DAC7760使用24位通信帧向器件写入数据,因此您可以估计通信所需的26个时钟周期(CS需要另外两个时钟周期)。  我认为您的应用程序在时钟速度方面有很大的余地。

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    在7.6 电气特性中:交流

    0-10V

    输出电压设置时间:22微秒,转换速率0.5V/micro s,转换时间=10/Micro=20 0.5 微秒

    22-20=2,这2微秒有什么作用?

    假设 输出电压周期时间为1毫秒。

     写入时钟频率:26* 1000 = 2.6万 Hz

    最低SPICLK:LSPCLK/128=200MHz/128=1.56MHz

     不能减小写入时钟。

    正在尝试增加转换时间。

    转换时间=输出更改/步长*更新时钟频率*LSB大小

    输出 变化: 10V

    步长:8

    LSB大小:2.441 mV

    转换时间:1毫秒

    更新时钟频率=10/8*512KHz 2.441  

    更新时钟频率(在表6. 转换速率更新时钟(SRCLK)选项)无法满足要求。

    我的考虑是否正确?

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    京泰

    稳定时间的较小时间部分通常称为'小信号步长'。  例如,DAC可能会在转换率定义的时间内满足最终值的1 % ,但需要额外的时间才能满足0.01 %。  

    我认为没有必要降低时钟速度来强制每1毫秒写入一次。  而是在微控制器中使用计时器,每隔1毫秒写入一个值。  SPI帧的实际速度可能比26KHz快得多。  

    只是为了澄清一下,您是否在尝试生成1千赫的三角形或锯齿波?  是否有需要转换限制的原因?

    保罗

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     至伺服控制器,PLC和CNBC的0-10V/+/-10V信号输出,一些客户称频率为1KHz,但根据TIDA-0.017万,TIDA-0.0119万,没有限制。 我正在检查伺服/PLC /CLC的频率响应。 您知道吗?

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    虽然我不确定这些设备的频率响应,但我认为在DAC8760的转换功能和DAC的定时微控制器更新之间,您应该能够适应广泛的频率范围。

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    感谢您的支持。