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[参考译文] DAC34SH84EVM:时钟和计时说明。

Guru**** 2383310 points
Other Parts Discussed in Thread: DAC34SH84, DAC5675A-SP
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/603240/dac34sh84evm-clock-and-timing-clarification

部件号:DAC34SH84EVM
主题中讨论的其他部件:DAC34SH84DAC5675A-SP

大家好,

对于我的其中一个设计,我需要生成两个独立的DAC输出电压(仅具有几个独立步长) @ 400 MHz及以上。 两个输出应与DAC时钟同时变化。

最初,我使用了TI 2通道DAC EVM,认为这将为我提供两个输出,它们将同时更改。 但我意识到Ch1和Ch2输出是半时钟间隔,因为输入数据接口是LVDS DDR。

检查TI的其它DAC后,我发现DAC34SH84是具有两个单独的16位LVDS输入的高速DAC (1.5 GSPS)。 Ch1和Ch2是时间多路复用DDR (数据端口1),同样,Ch3和CH4也是时间多路复用DDR (数据端口2)。

我现在有三个问题。

1.由于DAC34SH84中有两个单独的输入数据端口(通道1和通道2在输入数据端口1上是时间复用,同样 ,通道3和通道4在输入数据端口2上是时间复用),我将在通道1和通道3上获得同步输出更改 (Ch2和CH4也是如此)? Ch1和Ch3 (同样的Ch2和CH4)输出是否会随DAC时钟的相同边缘而变化?

2.数据表显示这些DAC输出的上升/下降时间为300马力。 DAC34SH84 EVM输出上的上升/下降时间是否相同(因为输出是变压器耦合的)?

3. TI的人员能否实际测试DAC34SH84EVM 并确认EVM输出的上升/下降时间?

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    Jayant

    我们正在研究这一问题。

    此致,

    Jim

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    Jayant

    DAC使用内部FIFO来保证所有输入数据同时到达所有DAC。 因此,对于您的情况,您可以使用4个DAC中的任何或全部。 我正在检查我们是否有测试数据来测量DAC的上升和下降时间。 有人告诉我,数据表中的规格非常宽松。 这适用于什么应用程序?

    此致,

    Jim

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    您好,Jim:

    我的应用程序用于卫星发射器设计。

    我已经使用National Instruments (NI)的外部任意波形发生器(AWG)设计和测试了我的proto RF系统。 此AWG使我的上升/下降时间为1-2 ns。

    我的最终设计将包括两个TI DAC (部件号DAC5675A-SP),其中介绍了300PS的上升/下降时间(对于我的应用来说相当合适)。

    现在,在  我在设计审查团队面前总结"发送器输出波形的最终可实现质量参数"之前,我需要使用外部DAC测试系统,该DAC具有两个通道输出同时变化,上升/下降时间优于300马力。

    我希望我已经回答了你的问题。

    等待   DAC34SH84EVM的连接器J7 (IoutA2),J6 (IoutB2),J3 (IoutC2)和J2 (IoutD2)上输出的上升/下降时间的回复。

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    Jayant

    上升和下降时间受到 PCB的强烈影响,如果我们尝试在EVM上进行此测量,它可能 与 您在电路板上看到的值不匹 配。  我们的设计团队建议您计划使用 PCB/负载进行建模/测量。  此外,由于我们的带宽有限,我们将无法在不久的将来进行这些测量。 如果您愿意,我可以向 您发送一个替代EVM,让您自己尝试。

    此致,

    Jim  

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    您好,Jim:

    我从TI获得EVM。

    我的仪器具有非常高的BW来测试上升/下降时间。

    我将进行测量并与您分享EVM的结果。