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[参考译文] ADS5407:ADC同步与放大器;SYNCOUT

Guru**** 2380860 points
Other Parts Discussed in Thread: ADS5407, DS10BR254
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/630643/ads5407-adc-sync-syncout

部件号:ADS5407
主题中讨论的其他部件:DS10BR254

在我的项目中,我必须将16个平台上的64个ads5407与K7 (Xilinx) FPGA同步,现在我遇到了如下问题:
我有通过LVDS缓冲器(DS10BR254)的同步信号来链接到直流耦合中的ADS5407,但我发现SYNCOUT信号不是完美的脉冲序列,因为信号来自ADS5407数据表中提到的5位计数器。

I do set HP Mode=1,(0x01,D1)(我确实要设置HP模式=1,(0x01,D1)

所以我认为ADC没有正确同步,我想我的操作是否有一些错误的步骤?

您可以通过电子邮件与我联系,我的电子邮件 地址是zhouleichen@163.com

谢谢!

ZhouLc.

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    Zhoulc,

    您正在使用其中多少个中继器?  您是否向它们发送每个ADC数据表中的单个脉冲或32个时钟周期信号? 64个转换器中是否有任何一个是同步的? 您的采样速度有多快? Xilinx设备是否存在定时问题?

    此致,

    Jim  

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    你好,Jim,
    我尝试测试与2个ads5407和FPGA的同步,在我的项目中,样品clk为500MHz,因此我有FPGA来为同步输入生成周期脉冲(15.625M)。 所有2个同步信号都由低偏斜的缓冲器分配,PCB中的布局长度相同。 此外,两种格式的同步信号(定期脉冲同步和一次性脉冲同步)都经过测试,没有任何改进。

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    Zhoul,

    您能否发送两个部分的输出,CLK和SYNC_In的屏幕截图? 它们关闭了多少个时钟周期?  此数量是否从输入同步更改为输入同步上升沿? 您是否尝试过仅使用单同步脉冲?

    此致,

    Jim

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    图1显示了ads5407同步针脚处的同步信号。 正如我之前所说,它是一个15.625MHz的周期脉冲,每32个CLKIN (500MHz)周期重复一次。

    图2是芯片范围视图窗口, 红色信号是FPGA产生的同步信号,板载信号与图1相同。 但是来自SyncOut引脚的SYNC_ref信号不稳定且不是定期的。 我尝试过一次脉冲,但结果相同。

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    您好,Jim:
    我在下面的网站上找到了解决问题的方法,我建议TI修改数据表。
    e2e.ti.com/.../148.1154万
    谢谢,ZhouLC