[参考译文] DAC38RF82：无法从DAC生成信号：仅单音。

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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/656527/dac38rf82-unable-to-generate-signal-from-dac-single-tone-only

部件号：DAC38RF82
主题中讨论的其他部件： TSW14J10EVM

我正在尝试通过板载DAC38RF82从定制板获得正确的传输。但是，当DAC时钟为9000MHz时，我唯一能让DAC执行的操作是2250MHz的恒定频率或562.5MHz的恒定频率(具有不同的设置)。我想我在芯片的设置或JESD通信的设置上遗漏了一些东西，但是DEC表明一切正常工作–我只是无法从设备中获得与JESD通信相关的信号作为开始工作的起点。如有任何帮助，我们将不胜感激。

设置如下：

该芯片连接到Xilinx Kintex-7 FPGA，该FPGA在8条线路上以7.5Gbps的速率生成JESD204信号，并连接到DAC芯片。我使用频谱分析仪测试了JESD204信号，它似乎正在尝试发送信号。对于DACCLK引脚和SYSREF引脚，DAC芯片的输入时钟为375MHz。我正在使用板载PLL生成9000MHz参考DAC频率(M=6，N=1)。 DAC模式为单个(DAC A)，1个IQ对，插值为6x。

我附上了一个文件，其中包含来自评估板等效设置的屏幕截图。我发送的实际消息如下所示(十六进制，地址(2个字符)，数据(4个字符))

X"9万"，

X"0.786万"，

X"1.188万 "，

X"0200FF"，

X"0300FF"，

X"9.0004万"，

X"0B0000"，

X"1B0100 "，

X"0CA002"，

X"24.1001万"，

X"31.04万"，

X"32.0508万"，

X"33C318"，

X"3BA802"，

X"3C8229"，

X"3E0109"，

X"9.0001万"，

X"0A0310"，

X"0C2600"，

X"0D0301"，

X"0F1F83"，

X"19.0001万 "，

X"1E1111"，

X"1F1111"，

X"20.1111万"，

X"25.63万"，

X"2D1FFF"，

X"2E1FFF"，

X"32.08万"，

X"33.08万"，

X"4AFF03"，

X"4C1307"，

X"4D0101"，

X"4F1CE0"，

X"5.1001万F"，

X"9.0002万"，

X"0A03B0"，

X"0C2402"，

X"25.63万"，

X"4C1307"，

X"4D0101"，

X"9万"

测试如下：

电源导轨已测试且正在工作。我可以输出80 PLL输出时钟的下采样，频率看起来不错。报警指示主DAC PLL已锁定，SERDES PLL已锁定。 JESD的所有警报看起来都很好(没有通道或fifo错误)，同时检测到所有通道上的信号。但是，我获得DAC的唯一方法是输出任何内容，即在AB路径上启用混音器。完成此操作后，我会得到562.5MHz的连续音(以及谐波)。此外，如果我不能使用QRCLOCK_dac_ENA设置，它将产生2250MHz信号。似乎没有任何东西在使用来自JESD的信号输出。我只是看不出发生了什么问题，而且测试的选项已经用完了。如有任何帮助，我们将不胜感激。e2e.ti.com/.../DAC38RF82_5F00_Test_5F00_Settings.docx

7 年多前

0 admin 7 年多前

TI__Guru**** 2392905 points

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e2e.ti.com/.../3833.DAC38RF82_5F00_Test_5F00_Settings.docx

0 admin 7 年多前

TI__Guru**** 2392905 points

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Bryan，

使用Chipscope，您能否验证FPGA的所有8个通道是否都在通过CGS和ILAS并发送有效数据？此序列之后，来自DAC的同步是否会达到高水平且保持高水平？ TXENABLE高吗？

此致，

Jim

0 admin 7 年多前

TI__Guru**** 2392905 points

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我已经测试了FPGA的8个通道，它已通过CGS和ILAS，正在发送有效数据。来自DAC的同步较高，TXENABLE较高。通过测试车道条件，表明一切正常。

我有一个问题是时钟配置寄存器0x0A，QRCLOCK_dac_ENA是高还是低？对于您评估板发送的消息，它是高的，但对我来说应该是低的。但是，在低温条件下，我无法正常工作。

此外，我已经开始测试，将输入设置为"恒定输入"，仅用于测试。当我这样做的时候，我可以启用NCO并使事情更有效(可以创建一个大约600MHz的线频谱，37.5 MHz间距，但是它仍然没有多大意义。

0 admin 7 年多前

TI__Guru**** 2392905 points

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还有一个额外的小问题是，对于NCO，Sin和Cos查找表似乎只为2的组合而设计。如果假设偏移二进制，则它会产生大量谐波。

0 admin 7 年多前

TI__Guru**** 2392905 points

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进一步探测错误，我似乎同时出现错误状态"EQUNDER"和"EQOVER"。可能需要重置这些信息并更详细地阅读数据表的该部分。

0 admin 7 年多前

TI__Guru**** 2392905 points

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Bryan，

我使用您的设置运行了我们的设置。它需要连接至LMK的外部375MHz参考时钟。对于寄存器0x0A，使用的值为0x7C03。所有寄存器设置均可在附件中找到。看看这对您是否有帮助。

此致，

Jim

e2e.ti.com/.../Fs_5F00_9000_5F00_821_5F00_PLL_5F00_REF_5F00_375MHz.cfg

0 admin 7 年多前

TI__Guru**** 2392905 points

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您好，Jim：

感谢您提供配置文件，它应该能提供很大帮助。为了进一步帮助，您能否指明要使芯片正常工作所需按下的按钮顺序？您是只按应用程序上的LOAD CONFIGURATION FILE，还是也按一些额外的按钮(如“配置DAC”等)使其工作。只需解决所有重置和其他需要定义的设置。

谢谢！

Bryan

0 admin 7 年多前

TI__Guru**** 2392905 points

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您好，Jim：

仍然无法在这款芯片上取得任何进展...真的感觉我的头在撞击一堵砖墙。所有警报接合良好，我添加了与配置文件相同的设置。但是，结果相同-发射器没有任何信号。我监控了JESD204信号，当我更改传输信号时，它会改变。但是，当JESD204信号发生变化时，DAC输出没有变化。我可以通过启用混音器从DAC中获得振荡，但仅此而已。我还尝试使用MESTPATT模式测试JESD204信号，然后使用DTest输出结果，但是我无法成功，而且它也没有提供任何信息来告诉我我做了什么错误。为了进行测试，我在8.2121万帧的所有I/q值中输入了“101.0101万”模式...但我不确定这是否是正确的方法。

我觉得JESD204有问题。我使用的是标准Xilinx IP内核，但内核内几乎没有什么可调整的，所以我看不出有什么问题。 Vivado下是否有任何有助于您的示例代码？我已经尝试让这个芯片工作超过5周了，我开始认为这是不可能的。

此致，

Bryan

0 admin 7 年多前

TI__Guru**** 2392905 points

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另外，如果我发送一个信号，如JESD204信号上的所有“0”，则I和Q会产生线之间37.5MHz的线性频谱.... 这毫无意义。另一个不同的代码(例如 "0.0111万111000 "11.1万 ")将产生375MHz的线频。这对我来说相当奇怪...编码真的没有意义，因为它看起来不像8B/10B。

0 admin 7 年多前

TI__Guru**** 2392905 points

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现在我想一下，它可能与20的多帧设置有关。

0 admin 7 年多前

TI__Guru**** 2392905 points

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Bryan，

确保两端的K值相同，并且以下内容符合JESD204B标准：

17 < F*K < 1023

此致，

Jim

0 admin 7 年多前

TI__Guru**** 2392905 points

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Bryan，

您的目标是哪种Xilinx FPGA？我们在TI网站上的TSW14J10EVM产品文件夹下提供了使用KC705，VC707和ZC706的Xilinx源代码示例。 Xilinx网站上也有一些使用KCU105的示例。有关ADC和DAC与超大规模部件连接的详细信息，请参阅随附文档。

此致，

Jim

e2e.ti.com/.../1588.KCU105-HSDC-Pro-User_2700_s-Guide.pdf</s>2700

0 admin 7 年多前

TI__Guru**** 2392905 points

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感谢示例代码....帮助了一点，但要复杂得多，所以尝试将其分解。

看着我的代码，我想它可能是AXI4-lite接口。我认为这是多余的，而且核心向导一开始就能正确设置，所以除了为复位线路计时外，我没有连接接口(GND等)。它好像核心向导设置了通道数，但我不确定它是否将默认K值16更改为20，八位字节(F)是否从2更改为1。现在就着手处理这个问题。

您是否知道在示例代码中是否必须执行此操作？

0 admin 7 年多前

TI__Guru**** 2392905 points

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Bryan，

这是我从Xilinx联系人那里获得的有关您的问题的信息：

"如果客户在IP GUI中为F和K设置了正确的值，则这些值将用作核心寄存器的默认值。

这意味着客户不需要对这些寄存器进行编程。

他们是否知道内核是否在传输数据？

(用频谱分析仪探测SerDes线不会告诉他们这一点;-)

一个很好的线索是…

是否有数据流进入上的内核(TX_FEDY HIGH和TX_tdata更改)

如果不是，则…。

JESD204内核和JESD204_PHY是否已复位？ (通过JESD204 CORE AXI lite接口读取重置寄存器)

JESD204 PHY，PLL是否已锁定？ (此信息可通过PHY AXI lite接口获得)

TX内核非常简单。它只需要从重置和初始同步中退出。然后，它将开始传输。"

您是否可以将整个DAC配置文件发送给我，我将在设置中试用它？您是否遵循了启动顺序章节9.1 ．1中的所有内容？

此致，

Jim

0 admin 7 年多前

TI__Guru**** 2392905 points

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我已向AXI添加了一个接口并已探测其状态。一切看起来都很好。

AXI接口结果：

寄存器 x004–已完成重置

X008–启用了ILA支持。

X00C–无加扰

X010–全部为0

X014–3.

X018–全部为0

X020–0

X024—“1.0011万”(19)

X02C–子类1

X038–“0万000001000000000000000001”0.0001万”</s>0万 0万0.0001万

但是，对于X80C到X81C，我只能得到所有的0。不知道为什么？

浏览9.1 ．1的整个序列，它看起来都很好。 LFVOLT = 4。我最终得到的VCO调谐值与您得到的值(C5)相同。一切都如预期的一样

我正在发送的SPI命令如下所示，与您发送的命令相同。 (地址后跟数据“AAAADDDDDDDD”)

X"9万"，

x"0.586万"， --x"0.786万"， --启用报警输出

x"1.308万"， --x"1.188万"，

x"FF0000"， --它保持此状态，直至系统正常工作。

X"02FFFFF"，

X"03FFFFFFF"，

X"0400FE"，

X"5.0003万"，

X"6.0002万"，

X"78万"，

X"79万"，

X"7A0000"，

X"7F0008"，

x"FF0000"，

X"9.0004万"，

X"0A7C03"，

X"0B0002"，

X"0CA002"，

X"0DF000"，

x"1B0000"， - x"1B01"，

X"23FFFFFFF"，

X"24.1001万"，

X"31.04万"，

X"32.0508万"，

X"33C53C"，

X"34万"，

X"35.0018万"，

X"3BA802"，

X"3C8229"，

X"3D0088"，

X"3E0909"，

x"3F0052"， --需要反转某些线条。

X"9.0001万"，

X"0A0310"，

X"0C2402"，

x"0D0000"，--x"0D0301"，

x"0E00FF"，-- x"0EFFFFFFF"，

X"0FFFFF"，

X"10FFFFFFF"，

X"11FFFFFFF"，

X"12万"，

X"17万"，

X"19.0001万 "，

X"1C0000"，

x"1D0000"，

X"1E0000"，

X"1F0000"，

X"20万英寸，

X"21万"，

X"22万"，

X"23万"，

X"24.003万"，

X"25.63万"，

x"27.8888万"， -- x"27.2222万"，

x"28.033万"， -- x"28.022万"，

X"29万"，

X"2A0000"，

X"2B0000"，

X"2C0000"，

X"2D1FFF"，

X"2E1FFF"，

X"2F0000"，

X"30万"，

X"32.04万"，

X"33.04万"，

X"34万"，

X"35万"，

X"36万"，

X"37万"，

X"38万"，

X"39万"，

X"3A0000"，

X"3B0000"，

X"3C0000"，

X"41万"，

X"46.0044万"，

X"4.719万A"，

X"4831C3"，

X"4AFF03"，

X"4B1300"，

X"4C1307"，

X"4D0101"，

X"4E0F4F"，

X"4F1C60"，--x"4F1C41"，

X"50万英寸，

x"5.1001万F"，--x"5100FF"，

X"5200FF"，

X "53.01万"，

X"548E60"，

X"5C0002"，

X"5E0000"，

X"5F0123"，

X"60.4567万"，

x"64万"，

X"65万"，

X"66万"，

X"67万"，

X"68万"，

X"69万"，

X"6A0000"，

X"6B0000"，

X"6C0000"，

X"6D0000"，

X"6E0000"，

X"9.0002万"，

X"0A0310"，

X"0C2402"，

X"0D0000"，

X"0E00FF"，

X"0FFFFF"，

X"10FFFFFFF"，

X"11FFFFFFF"，

X"12万"，

X"17万"，

X"19.0001万 "，

X"1C0000"，

x"1D0000"，

X"1E0000"，

X"1F0000"，

X"20万英寸，

X"21万"，

X"22万"，

X"23万"，

X"24.002万"，

X"25.63万"，

X"27.8888万"，

X"28.033万"，

X"29万"，

X"2A0000"，

X"2B0000"，

X"2C0000"，

X"2D1FFF"，

X"2E1FFF"，

X"2F0000"，

X"30万"，

X"32.04万"，

X"33.04万"，

X"34万"，

X"35万"，

X"36万"，

X"37万"，

X"38万"，

X"39万"，

X"3A0000"，

X"3B0000"，

X"3C0000"，

X"41万"，

X"46.0044万"，

X"4.719万A"，

X"4831C3"，

X"4A0003"，

X"4B1300"，

X"4C1307"，

X"4D0101"，

X"4E0F4F"，

X"4F1C60"，

X"50万英寸，

X"5.1001万F"，

X"5200FF"，

X "53.01万"，

X"548E60"，

X"5C0003"，

X"5E0000"，

X"5F0123"，

X"60.4567万"，

x"64万"，

X"65万"，

X"66万"，

X"67万"，

X"68万"，

X"69万"，

X"6A0000"，

X"6B0000"，

X"6C0000"，

X"6D0000"，

X"6E0000"，

X"9.0001万"，

X"24万"，

X"5C0000"，

X"9.0004万"，

X"0AFC03"，

X"0A7C03"，

X"9万"，

X"0.5863万 "，

X"9.0001万"，

X"24.002万"，

X"5C0003"，

X"9万"，

X"0.586万"，

X"4万"，

X"5万"，

X"9.0003万"，

x"64万"， --清除

X"65万"，

X"66万"，

X"67万"，

X"68万"，

X"69万"，

X"6A0000"，

X"6B0000"，

X"6C0000"，

X"6D0000"

JESD204内核不能复位，PLL锁定输出按预期高电压。

所有警报都指示芯片正在工作。

第0页，0x4 =所有'0’s

第0页，0x5 =所有'0’s

第1页，0x64到0x6D =所有'0’s

第2页，0x64到0x6D =所有的0 (这并不重要)

第4页，0x76 =所有0。

我还可以看到TData的变化。除此之外，如果我在工作时使用频谱分析仪探测JESD204线路，当我更改数据线路上发送的内容时，我可以看到频谱的变化。

DAC的sysref是375MHz信号。 FPGA的sysref是23.44MHz信号。不确定这些？

一般来说，我想从DAC中获取任何信息，此时我真的不在乎它是什么…。只要它与我通过JESD204b接口发送的内容相关。

芯片的所有电压均正确。

我测试了另一个板，结果相同–不是焊接问题。

不确定还能做什么？

0 admin 7 年多前

TI__Guru**** 2392905 points

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您好，Jim：

我花了一天时间尝试让8位模式工作，输入频率为1500MHz，直接连接到DAC (无PLL)，但同样也有同样的问题....除非启用混频器，然后只能使用单个频率(93.75MHz)，否则无法直接获得输出信号。

我使用的是自定义主板，而不是开发主板，因此我无法直接向您发送配置文件。除了以下几点之外，我还遵循启动顺序：

1)在TXENABLE被拉低之前，电源滑轨启动。

2) TRSTB引脚接地，因此我无法控制它。

我所做的所有其他事情都是按照9.1 1 (我想)。

如有任何帮助，我们将不胜感激。

此致，Bryan

0 admin 7 年多前

TI__Guru**** 2392905 points

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Bryan，

开机并应用DAC CLK后，需要切换Restb。保持TRSTB处于低位是可以的。我为K和RBD运行设置时的值都为20。请在您的设置中尝试此操作。对于K，此值为20，SYSREF的最大速率为75MHz。我使用的值为3.125MHz。我会尝试使用较低的费率，以使您的设置尽可能接近我的设置。如果K =20，则在375MHz时使用SYSREF可能是您的问题。您能否发送您的原理图副本？您的Serdes通道的路由是否与EVM相同？

此致，

Jim

0 admin 7 年多前

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您好，Jim：

感谢您的帮助，是的，是的，这是SYSREF信号太高(375MHz)。我更改了设置，使SYSREF的性能更低，我最初尝试了3.125MHZ，但由于某种原因，它对于时钟生成芯片来说有点太慢了，所以我最终选择了11.7.1875万 MHz-3000MHz/256，现在每次都运行良好。

非常感谢您的支持，感谢您发现问题....这些芯片非常复杂，很难浏览数据表中的所有元素。下次我在美国的时候，或者下次你在澳大利亚(布里斯班)的时候，我应该给你一杯啤酒。

此致，

Bryan

数据转换器（参考译文帖）

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