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[参考译文] ADS7279:MISO 在 SCLK 的下降沿发生变化

Guru**** 2514085 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1134490/ads7279-miso-changes-on-falling-edge-of-sclk

器件型号:ADS7279

我们观察到 MISO 数据在 SCLK 的下降沿发生变化    

如果这是正确的解决方案、我们可以翻转接口以使用上升沿、但这不是数据表所描述的。 请提供建议。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    英里、您好、

    您能否提高逻辑分析仪上的采样率以获得更陡的边缘? 我还想了解您运行的 SCLK 频率。 如果您能分享这些细节、那将会很棒。  

    此器 件在 CPOL = 0、CPHA = 1或 CPOL = 1、CPHA = 0时工作、但看起来 SCLK 处于低闲置状态、因此我希望数据在上升沿移出。 如果您是开关 SPI 模式、会发生什么情况? 由于信号边沿不是很清晰、因此可能只是视觉误解。 您是否无法正确读取/写入器件?

    此致、

    Aaron Estrada

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    感谢您的快速响应! SCLK 频率为500kHz。 我们能够对器件进行读/写操作、但它不一致、并且对某些子系统开启时耦合到系统中的噪声敏感。 很抱歉、我当时使用的低带宽捕获。 这是具有更高带宽(最高可达此仪器)的捕获。 遗憾的是、我们今天早上刚刚发现该项目将暂停、因此我无法运行实验来更改 SPI 模式。  

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    英里、您好、

    感谢您提供详细信息。 由于工程处于暂停状态、您是否要在工程备份时停止调试并继续? 如果无法访问 ADC、则调试将非常困难。 请告诉我。  

    此致、
    Aaron Estrada