[参考译文] TSW14J57EVM：TSW14J57EVM

admin

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器件型号：TSW14J57EVM

您好！

我们对用于构建原型的 TSW14J57和 ADCxxDJxx00RF-TRF1208评估模块感兴趣，需要了解 EVM 上 FPGA 的功能，特别是如果我们可以将自己的 RTL 写入其中，以及它的容量(代码空间) 它是否具有逻辑的时钟速度以及是否存在任何限制。

如果我们可以与应用工程师联系、这将非常有帮助。

谢谢！

0 admin 3 年多前

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您好、Gaurav、

我认为答案是否定的、但我将确认、我们不允许您在 TSW 数据采集板的 FPGA 中使用或重新配置 RTL 代码。

我认为最好使用 Xilinx DevKit 或类似工具来实现这一点。 ADCxxDJxx00RF-TRF1208评估模块将连接到这些类型的具有 FMC 连接器的开发套件。

此致、

Rob

0 admin 3 年多前

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您好、Gaurav、

我还应该指出、J47具有 Intel FPGA。

我最好从我们的 JESD IP 链接中申请一些示例： www.ti.com/.../TI-JESD204-IP

在这里、我们可以让您快速开始接口开发。

此致、

Rob

0 admin 3 年多前

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Rob、您好、感谢您的回复。请检查我们是否可以写入 TSW 数据采集板的 FPGA。最好使用全 TI 解决方案。如果 TI 可以提供定制解决方案、让我们可以写入 FPGA、我们也可以考虑这一点。

请告诉我们。

谢谢

高拉夫

0 admin 3 年多前

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您好、Gaurav、

遗憾的是、不能写入 TSW 数据采集板的 FPGA。

最好从我们的 JESD IP 链接中获取一些示例： www.ti.com/.../TI-JESD204-IP

请改为考虑这条路线、我们可以通过这种方式帮助您的发展。

此致、

Rob

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