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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/899602/ads4122-direct-clocking
您好！
ADS4122是否支持直接时钟或 ASIC 是否改变内部时钟信号(例如 PLL、DCS 等)？ 在数据表的图93中、 有一个输入缓冲器、可以直接看到采样电路的分支、而第二个连接则连接到内部时钟发生器。
该时钟发生器是否仅用于同步所需的输出时钟以及所需 SC 电路的正确时序(电荷注入等) 或者是否有完整的时钟恢复？
Gecko、
发生 器执行所有内部功能所需的同步和适当的时钟分配。 它允许根据设置和保持时间进行调节、使用上升沿或下降沿并 根据输出数据移动输出时钟。
此致、
Jim
尊敬的 Jim：
感谢您的快速响应。 因此、您的答案意味着采样保持级直接在输入时钟上工作(内部缓冲除外)、而其他内部时钟则是从输入时钟内置的。
我的应用程序希望在外部源的时间点准确采样。 然而、这个时钟源不是一个稳定(非等距采样)信号。 内部和输出时钟会发生什么情况(对于 PLL 电路、这会非常糟糕、因为有环路...)？
Gecko
您能否发送一个波形图来显示此输入时钟的外观。 如果没有这些信息、很难回答这个问题。
Jim、
遗憾的是、我没有时间生成波形图。 不过、它是振幅不断变化的线性调频脉冲信号。 例如、记录期间信号增加的频率。 同时、振幅会首先增大、然后再次减小。 占空比要求处于保持状态、频率/振幅不会出现跳变。
我询问的是时钟输入、而不是模拟输入。
它是时钟输入。 时钟源由物理过程生成。 我们的数据输入由相同的过程生成、我们希望在时钟信号给出的时间点对数据进行采样。
我知道很难回答这个问题。 但是、我想我们是否可以在给定的时间点进行采样(使用 S/H 级)、然后使用不精确的时钟处理其他级、我们就会获得所需的。 我们的主要关注点是、有一个 PLL 或其他环路时钟频率变化有问题。
时钟输入具有占空比、相位、共模和振幅要求。 对我来说 、听起来您可能违反了所有这些标准。 如果其中任何一个都是如此、则不能保证此器件能够正常工作。
占空比、共模和振幅要求保持不变。 随着频率的变化 、相位要求可能会成为一个问题。 我不确定、如果我理解正确的话。 您能告诉我在数据表中的哪一章中找到了相位要求吗？
储罐。
请参阅第7.3和9.1.2节。
谢谢 您的参考。我已经考虑了这些问题。 在我满足这些要求时、我应该能够使用该器件。 这可能是 SNR 等性能参数的问题。因为我有一个不理想的时钟(频率的变化在某种程度上可以被视为抖动)。 我想我必须设置这样的系统并进行我自己的测量。 感谢您的支持。
