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[参考译文] ADS54J69:最低器件时钟频率

Guru**** 1828310 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/893559/ads54j69-minimum-device-clock-frequency

器件型号:ADS54J69

在 ADC 的参数选择中、最大采样率指定为500Msps、但未列出 miimum。 我曾假设在应用2倍抽取时器件时钟频率可高达1GHz、否则最高可达500MHz。 不过、通过查看数据表的"重新计算运行条件"章节7.3、我们可以看到系统时钟的最低频率为500MHz。 实际上、这是最小输入频率还是最小值500Msps? 例如、如果我想使用300MHz 的外部时钟、这是否允许我获得150/300的有效采样率、具体取决于抽取设置? 查看等效器件和 DAC 等、通常仅列出器件时钟最大值或显著降低的最小值。 500MHz 至1GHz 似乎受到很大限制。 非常感谢。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Bryan、

    数据表不是100%正确。 最小采样率来自  此器件可支持的最低串行器/解串器速率、即2.5Gbps。  如果 您使用的是20倍模式 (LMFS = 4222)、则使用500MHz 的 ADC 采样时钟(输入时钟而不是抽取率)将是最小限制。 如果使用40x 模式(LMFS = 2242)、 最小 ADC 采样时钟 将为250MHz。

     

    此致、

     

    Jim

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    非常感谢 Jim 的回答。

    实际上、我们正在研究2242配置、该配置为5G SerDes 提供500MHz 系统时钟、并为250MSPS 提供/2抽取。 知道我们可以安全地减少这种情况是非常好的、并且将允许任何低至125MSPS 的数据

    这确实为我们打开了选项。

    最恰当的考虑

    Bryan