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[参考译文] ADC12DJ5200RF:ADC SNR vib

Guru**** 2540720 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/917302/adc12dj5200rf-adc-snr-under-vib

器件型号:ADC12DJ5200RF

团队、

我有一个需要高速 ADC/DDC 的项目。 在对 TI 的“射频采样培训讲座”进行认真研究时,有一节讲述了受采样时钟相位噪声(抖动)影响的 ADC SRN。  材料…也提供了一份非常有用的正式文件。

 

总相位噪声是相位噪声图(采样时钟)…的积分(来自 f1 ~ f2)。  我的问题是:如果您知道射频输入信号频带(路由到 ADC)、如何确定 f1和 f2?  

 

我的应用将处于高通孔环境中。 我知道如何根据 OSC g-sensivity 和 vib 系统配置计算 vib 下的等效相位噪声、但当我计算 vib 下的 ADC SNR 时、相位噪声频带(f1和 f2)应该在相位噪声图上使用什么?

 

如果您有答案或我可以参考的任何文章、请告诉我…。

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    请参考下面的幻灯片、了解相位噪声计算。 请注意、时钟相位噪声 计算本质上独立于射频工作频带。  F1的选择通常由您的应用程序决定。  您需要测量多低的频率偏移。  例如、LTE 信号的第一个子载波频率为7kHz、因此低于该偏移的噪声不会产生后果。  其他应用可能在非常低的偏移下具有信息、因此要求 F1非常低...类似于100Hz 或1KHz。

    F2通常受时钟的 BW 限制。  经验法则是时钟带宽是最大时钟速率的2倍。  在实践中、您可能不需要走太远、因为您可能在时钟输入上有一些带限滤波器和/或时钟相位噪声在非常高的偏移下达到本底噪声、因此与中的较近者相比、贡献不大。  大多数仪器被限制在40MHz 或者100MHz 的偏移、这是可以接受的、这是因为到那时、器件几乎肯定在本底噪声中。

    -RJH

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