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[参考译文] ADS8685:如何重试以从 ADS8685获取转换结果?

Guru**** 2382480 points
Other Parts Discussed in Thread: ADS8685
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/944205/ads8685-how-do-i-retry-to-get-conversion-result-from-ads8685

器件型号:ADS8685

三个 ADS8685-s 通过菊花链连接到 FPGA (MAX10)。
FPGA 通过 SPI (而非 multi-SPI)与转换器进行通信。 FPGA 是 SPI 主设备。

ADS8585具有奇偶校验功能、因此我认为 FPGA 可以通过奇偶校验错误在传输时发现错误。
如果发生错误、我将重试以获得相同的转换结果。

问题1:ADS8685能否输出相同的结果? (是否可以重试?)
问题2:FPGA 如何获得相同的结果? 我想知道序列以获得结果。


根据数据表(ads8685.pdf、revC) p39图73、当 FPGA 发送超过32个 SCLK 时、该转换器会输出一次转换结果。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你好、Takuya、

    输出数据仍然存在、并且在没有任何新的 CONVST/CS 信号的情况下不会更改、但我认为您不会再次获得相同的数据。 数据传输从 CONVST/CS 信号的下降沿开始、主机控制器拉低 CONVST/CS 以启动数据传输、ADC 控制数据总线、输出数据字的内容加载到输出移位寄存器中、 输出移位寄存器数据的 MSB 在 SCLK 的启动边沿 SDO 引脚上移出。

    当您在帧 F 中发现数据传输错误时、数据已在前16个 SCLK 内移出到 SDO。 如果接收到更多大于32的 SCLK、SDO 上的数据将为0。 因此、您无法在同一帧中再次获取数据。

    如果要将 CONVST/CS 拉回高电平然后拉回低电平以在 F+1帧中启动新的数据传输、则转换数据将更新、因为在 CONVST/CS 信号的上升沿启动了新的数据转换。

    此致、

    戴尔

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    您好 Dale、

    感谢您的回复。
    您的意思是该转换器不发送相同的转换结果吗?

    (我英语不太好、所以请让我确认。)

    此致。

    Takuya

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    你好、Takuya、

     数据传输从主机控制器启动的 CONVST/CS 信号的下降沿开始、对于 SPI-00模式、ADC 会在 SCLK 的下降沿将转换数据加载到输出移位寄存器中、同时加载 SDO 线、 因此、ADC 发送转换数据没有任何问题。 问题是、当您将 CONVST/CS 信号拉回到高电平(上升沿)、然后将其拉至低电平(下降沿)以读取转换数据时、由于同一 CONVST/CS 引脚是双功能引脚、因此您尝试第二次读取的先前的转换数据已更新、   CONVST/CS 信号的上升沿 触发了新的数据转换。

    希望这有助于您理解。

    此致、

    戴尔

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    您好 Dale、

    我明白了。

    总结:
    -如果帧 F 中的 SCLK 超过32个、则数据将输出0。因此、我无法在同一帧中获得相同的结果。
    -使用新的 CONVST/CS 信号、ADC 输出在 F+1帧中更新。

    非常感谢您的帮助。 很抱歉打扰你。

    此致。