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[参考译文] ADS42LB69:在 ADC 采样数据上观察到尖峰(模拟输入和模拟斜坡数据均为)

Guru**** 2386610 points
Other Parts Discussed in Thread: LMK00304
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/932751/ads42lb69-spike-observed-on-the-adc-sampled-data-both-with-analog-input-and-simulated-ramp-data

器件型号:ADS42LB69
主题中讨论的其他器件:LMK00304

大家好、

我在 PCB 中使用的是8通道(4双通道) ADC。 当前应用的采样频率为50MHz、IF 为60MHz。 SNR 和动态参数符合我的要求、但偶尔会在 FPGA 上观察到采样数据的尖峰。 在同一实例中、在所有8个通道上观察到尖峰

采取的行动:

1:ADC 中的仿真斜坡波形并检查一致性。 -->在同一实例中所有 ADC 的斜坡模式中观察到的尖峰(尖峰不是很频繁, 找不到重复频率)

2.在 FPGA 的输入端使用更高的采样时钟倍数(采样时钟的4倍以上)进行监控-->即使在该数据中也观察到尖峰(FPGA 捕获是毋庸置疑的)

由于所有 ADC 在同一实例中都显示 Spike、  

a.验证了 ADC 电源的纯度:1.8V 和3.3V 上的纹波值小于40mV

b.验证了时钟的一致性:在 PCB 上的采样时钟(恰好在 FPGA 之前)上未观察到杂散频率  

注:

SNR:70dBm,无尖峰;~55dBm,Spike

2.采样时钟被馈送到 LMK00304、输出被馈送到所有 ADC

3.时钟架构已在较早的电路板中得到验证,并已验证其一致性

请建议我使用其他方法来验证 ADC 数据中的尖峰源。

此外、请回复任何其他查询

提前感谢

Arunkumar Jadhav

+91-8277606706

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    阿伦库马尔

    当出现此尖峰时、大多数位是否会发生转换、从而导致功率浪涌? 如果您关闭 ADC 的1、2或3电源、是否会出现此问题?

    您能否监控 OVR 引脚以查看是否发生超出范围的情况? 您是否尝试提高 LVDS 数据强度? 您使用的是 DDR 还是 QDR 模式?

    采样率较低时是否会出现此问题?

    此致、

    Jim