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[参考译文] DAC39J84EVM:外部时钟(后续)

Guru**** 2386610 points
Other Parts Discussed in Thread: DAC39J84EVM, LMK04828
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/931223/dac39j84evm-external-clock-follow-up

器件型号:DAC39J84EVM
主题中讨论的其他器件: LMK04828

可能涉及的人员、

目前、我能够将以下配置用于 DAC39J84EVM 和 KC705 FPGA。 它工作得非常好。

现在、我想使用400MHz 的 DAC 频率和200MHz 的 FPGA 频率、这是无法在板上生成的。 相反、我必须使用 J17来提供外部时钟。  

但是、在我对快速入门页面进行编程后、默认设置无效。  

您是否会告诉我如何重新配置 LMK04828设置、使其与之前工作的设置相匹配、但频率上只有一个差异?

希望很快收到您的回复

谢谢你。

微裕

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    Weiyu、

    注意:Xilinx 开发平台上使用的速度等级为-2的 GTEX2收发器的最大速率为10.3125Gbps。 此外、KC705收发器具有8Gbps 至9.8Gbps 的频带隙、SerDes 将不会在其中运行。

    您的设置可能无法在8Gbps 串行器/解串器速率下工作。 您可能需要关闭时钟。 如果您仍想尝试此操作、请参阅附加文件以了解 LMK 设置。

    此致、

    Jim

    e2e.ti.com/.../Program-DAC-and-LMK-as-shown-below-with.pptx 

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    您好、Jim、

    感谢你的帮助。  

    您能否告诉我、如果 GTX 无法在 8 Gbps 至9.8 Gbps 范围内运行、会出现什么现象?  

    我只能在明天进行测试。

    微裕

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    我不记得。 错误数据或 SerDes PLL 不会锁定。 您必须联系 Xilinx 以获取有关此方面的更多信息。 这是许多年前的问题。 到目前为止可能已经更正了。

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    您好、Jim、

    谢谢。 我应该为 J17提供什么电源?

    微裕

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    Weiyu、

    根据 DAC3XJ8XEVM 用户指南、6dBm。

    此致、

    Jim