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[参考译文] DAC1220：SPI 通信

admin
Guru**** 2381820 points
Other Parts Discussed in Thread: DAC1220
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/764034/dac1220-spi-communication

器件型号：DAC1220

您好、TI、

我只是对在设计中使用 DAC1220有一个简短的问题。 我正在使用三线制 SPI、想知道在该配置中、我是否可以在同一总线上使用多个器件与该特定芯片？

感谢你能抽出时间、

Michael

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    TI__Guru**** 2381820 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Michael、

    根据数据表、允许进行此配置、但我要指出第8页上的注释、也粘贴在下面：

    "串行时钟限制为主时钟频率的十分之一。 对于2.4576MHz 主时钟、串行时钟不能超过254.76kHz。 设计人员应牢记这一点、因为这可能会阻止 DAC1220与其他 SPI 器件共享或放置在 SPI 总线上、而 SPI 总线的运行速度可能快得多。"
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    TI__Guru**** 2381820 points
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    尊敬的 Kevin：

    我知道数据表的这一部分、我的问题是、如果没有、我可以在一条三线制 SPI 总线上使用三个 DAC1220
    是否有任何沟通问题、或者通过这样做、我是否为自己设置了问题？

    此致、

    Michael
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    TI__Guru**** 2381820 points
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    Michael、

    虽然我自己没有测试过这一点、但我看不到为什么它不起作用。

    第11页表示当 CS 为高电平时、器件将忽略 SCLK 上的所有活动、因此从 DAC1220的角度来看、连接其他器件时不应影响 SCLK 上的所有活动。

    虽然没有明确说明、但我相信 SDIO 引脚的默认状态是高阻态、基本上处于输入模式、所以 DAC1220也不会影响总线上的其他活动。 SDIO 仅在执行寄存器读取时由 DAC1220驱动、这意味着 DAC1220 CS 引脚被驱动为低电平。 我是根据"串行接口"部分第8页的最后一段来假设这一点的。