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[参考译文] DAC38RF82:DAC 杂散问题

Guru**** 2391675 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/840427/dac38rf82-dac-spur-questions

器件型号:DAC38RF82

大家好、

我们有客户询问以下给定链接中的文档"用于优化射频采样 DAC 中的杂散和相位噪声的高效电源参考设计":

 图6显示了杂散抑制(dBc I put)与纹波频率之间的关系、但该轴标记为纹波电压(mV pk-pk)与纹波频率之间的关系。 是否有以前的信息?

仅显示了三个电源(VDDCLK1、VDDA1和 VDDPLL1)的杂散抑制与射频输出频率间的关系图。 是否有关于其他时钟和模拟电源的任何信息? 尤其是当其中一些像 VDDCLK1一样对纹波敏感时。 我假设数字电源上的纹波没有影响、只要它不是很高(>50mV)、但确认是很好的。

如何为这些测试配置 DAC (一个或两个 TX、采样率、内插)?

4.对于高达4.5GHz 射频输出的杂散性能是否有任何信息?

如果您需要客户提供的更多信息、请告诉我。

谢谢!

Jonathan

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    Jonathan、

    我们正在研究有关上述文件的问题。 关于高达4.5GHz 射频输出的杂散性能、数据表中有许多图表显示了这一点。 请参阅图4-6了解 HD2、图7-9了解 HD3、图10-12了解 SFDR。 这些都达到4.5GHz。 这些是通过2 TX 完成的、 Fdac = 8847.36Msps、内插因子为12。

    此致、

    Jim

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    您好、Jim、

    感谢您的支持和回答上述一些问题。
    我们期待着从其他问题中听到更多的信息。

    谢谢!

    Jonathan

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    Jonathan、

    从事该文章的人员不再与 TI 合作。  对于 完成此测试时器件处于何种模式、我们没有答案。 我将遵循文件中关于哪些用品比其他文件更敏感的准则。 如果您不打算使用 DAC PLL 和输出时钟分频器、则前面提到的几个电源 将不需要这样一个干净的电源。 对于>50mV 的纹波、我建议使用文档中所示的相同功率器件。 如果您决定使用其他器件、我建议器件 具有相同或更好的性能。

    此致、

    Jim   

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    您好、Jim、

    感谢您的回复。 我还有一个问题;很抱歉、如果它与最初的问题有些无关。 TI 是否具有应假定的电源的最大瞬态电流、最大稳态电流的百分比或测量值?

    Tom C

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    Tom、

    我们不会。

    此致、

    Jim