[参考译文] ADS1278：ADS1278数据吞吐量延迟

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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/670864/ads1278-ads1278-data-through-put-latency

器件型号：ADS1278
主题中讨论的其他器件： ADS131A04、 ADS127L01、 ADS130E08、 ADS131E08

我们正在研究的应用需要以至少14位的分辨率和大约10kHz 的最大目标频率对8个数据通道进行采样。我们还提供有限的可用尺寸。

我们选择了 ADS1278、但在输入变化和获得输出之间经历了大约1.4ms 的延迟。

此延迟对于需要小于100us 的控制环路来说太长。该器件当前设置为高分辨率模式、其时钟为15MHz、由于 SPI 传输限制、该模式是固定的。

是否仍有改进之处？

8 年多前

0 admin 8 年多前

TI__Guru**** 2765795 points

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尊敬的 Tracy：

感谢您发帖。

您观察到的延迟是 ADS1278中线性相位 FIR 滤波器的群延迟。这是滤波器输出响应模拟输入上阶跃变化的时间。对于高分辨率模式、此延迟通常为39个转换周期(请参阅电气特性表)。即39 /(15e6 / 512)= 1.33us。图66显示了滤波器的阶跃响应。

您是否需要此数字滤波器中的平坦宽带响应、或者具有低延迟正弦滤波器的器件是否适合您的应用？

此致、

0 admin 8 年多前

TI__Guru**** 2765795 points

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感谢重播。

是的，这就是我们得出的结论。

ADC 是伺服控制环路的一部分。正是步进变化和数据上升之间的延迟更重要、因此我认为后者是可以的。您的想法是什么？

0 admin 8 年多前

TI__Guru**** 2765795 points

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尊敬的 Tracy：

首先、如果您需要8个同步采样通道、我会考虑以菊花链方式将两个 ADS131A04器件连接在一起。在 OSR = 96 (Fdata = 42.67kSPS)时、您可以实现18.43位有效分辨率、在增益= 1时、带宽为-3dB、为11.18kHz。该器件中的 SINc3滤波器只需3个转换周期即可输出稳定的数据。通过滤波器的群延迟可近似为稳定时间的一半。

另一个具有相似滤波器架构的器件是 ADS127L01。数据速率可直接通过主 CLK 输入进行缩放。例如、OSR = 128的4MHz 时钟可为您提供12.7kHz 的带宽和19.99位的有效分辨率。对于8通道系统、这些器件还可以进行菊花链和同步。

此致、

0 admin 8 年多前

TI__Guru**** 2765795 points

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好的、感谢您的观看。

实际上、我们不需要24位分辨率14位的分辨率是否足够让事情变得更简单？

0 admin 8 年多前

TI__Guru**** 2765795 points

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尊敬的 Tracy：

还有一个16位版本的 ADS131E08、称为 ADS130E08。

此致、

数据转换器（参考译文帖）

数据转换器（参考译文帖）(Read Only)

[参考译文] ADS1278：ADS1278数据吞吐量延迟