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[参考译文] DAC8564:4个通道中的2个停止响应

Guru**** 2382480 points
Other Parts Discussed in Thread: DAC8564
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1227641/dac8564-2-of-the-4-channels-stopped-responding

器件型号:DAC8564

您好!

我正在设计一个电路板、使用由 Raspberry Pi RP2040控制的 DAC8564。 最初四个通道都正常工作、我确信写入的 SPI 命令是正确的、因为使用相同设置的不同设计已经成功应用、并在一段时间内继续工作。 此代码并未更改。

当我返回到工作板时、第二天的通道00和10停止响应、输出似乎处于随机电压。 我当时是以 Fluke 的身份写下这个文件、但第二个原型在最初的时间通道01和10以及之后不久的通道00也出现了同样的故障。

这些通道发生故障的原因可能是什么? 除了路由和电源之外、此电路板与以前可正常工作的器件之间没有区别。

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    您好、Hamza:

    请分享一个示意图、清楚地显示所有电源电压和输出负载。  

    有一些设置完全相同的电路板已经有一段时间了、到目前为止、两个采用新布局(布线)的电路板上的两个器件都出现了此问题? 是这样吗?

    您是否可以使用一个具有良好部件的合格电路板和一个具有可发现问题的部件的新电路板进行 A-B-A 交换?  

    此致!

    Katlynne Jones  

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    尊敬的 Katlynne:

    此处是原理图+布线图像、

    你的陈述是正确的,这正是我的情况。

    在我尝试 A-B-A 交换的同时、我唯一可以访问的旧电路板是由工厂进行无铅焊接。 由于两个产品都是昂贵的和芯片本身是昂贵的,所以犹豫是否可能生锈这两个。 我宁愿把它作为最后的手段。

    感谢您的帮助 Katlynne!

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    您好、Hamza:

    我们仍在研究这一点。

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    您好、Hamza:

     

    您能否捕获 DAC8564引脚附近的 CS、SCLK、DIN 和 LDAC 波形、以确保正确呈现图形。  

     

    谢谢。

    Sanjay

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    尊敬的 Sanjay:

    刚刚重新测试了每条线、波形正是我所期望的。 LDAC 目前通过焊接跳线接地、如果需要更高速度、我计划最终更新功能以包含该功能。  

    只是为了澄清一下、4个通道中的2个仍会响应设置电压的命令。

    此致!

    Hamza.  

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    您好、Hamza:

     

    如前所述、如果 您要在 DAC8564引脚附近的示波器上捕获 CS、SCLK、DIN 和 LDAC 波形、并将其发布在此处。 我需要检查并确保通信正常、并且没有违反时钟极性、时序问题和电压电平的情况。

    祝您度过美好的一天!

     

    谢谢。

    Sanjay

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    这是我的示波器的屏幕截图。 我以前没有分享过屏幕截图、因此如果需要进行任何更改、请告诉我。

    CS:

    SCLK:

    DIN:

    正如我提到过的、LDAC 引脚接地、该布线上也没有瞬变。

    此屏幕是我根据将所有四个通道的 DAC 电压设置为相同电压的情况进行刷新得出的结果。 请告诉我,如果你需要一个特写单个频道. 波特率设置为20MHz

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    您好、Hamza:

    一个命令的特写将非常有帮助。  我们要寻找的是时钟相位或极性不匹配。  当您只看到某个通道子集在工作时、这通常是个问题。  器件可能出现位移位、从而导致命令位未正确锁存。

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    这是我能轻松得到的最接近的地方、如果需要更清晰、请告诉我、如果需要、我会重试。

    CS:(此处的 TB 为1us、其他的 TB 为500ms)

    SCLK:

    DIN:

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    您好、Hamza:

    关键在于数据/时钟关系是正确的。  您能否同时进行采集? 我还建议您降低时钟速度。  从图中可以看出、时钟的线路电容太大、或者驱动能力对于该时钟速度而言是不够的。  

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    我将速度从20MHz 降至2MHz、并尝试在不希望的情况下更改 SPI 的极性和相位。 下面是 SCLK (顶部)和 DIN (底部)线的两个屏幕快照、请忽略 DIN 线上的过冲、我使用一个随机探头、我在测量高速信号方面没有太多经验、因此请原谅这一点。

      

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    您好、Hamza:

     

    感谢您分享波形快照。

    1.数据位(DIN)应在中保持稳定 SCLK 的下降沿  而不是在示波器波形中捕获到的上升时发生。 请查看第29页了解更多详细信息。

    2.另请确保按照数据表中的"时序要求"部分遵循时序参数。

    请进行这些更改、并告诉我们这是否有助于解决您的问题。  

     

    P.S.:当设备工作时,它可能是边缘的 DIN 设置和保持时间非常低。 在下降沿期间、DIN 可能会随机满足、但并不总是如此。  

     

    谢谢。

    Sanjay

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    尊敬的 Sanjay:

    为1。 我已尝试更改 SCLK 极性和相位、但没有结果、极性翻转时、会传播、因此 DIN 在下降沿保持稳定。

    为2。 我发现很难验证是否满足了时序参数、但我会继续尝试。 如果这是问题所在、是否会采用更好的做法来重新布线线路? 我不明白是否会随机满足 DIN 条件,工作信道也不会出现异常的行为? 更改波特率或写入通道的顺序是否也会影响?

    我今天也会尝试替换这块芯片。

    感谢大家到目前为止的帮助

    Hamza.

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    我更换了芯片、四个通道都在工作、我有旧的芯片、但它看起来像是被拆除后损坏的。

    如果通道再次开始出现故障、则会进行反馈报告。

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    您好、Hamza:

     

    好的、让我们知道问题是否再次出现。

    平均时间、前提是您可以在单帧中向我发送 CS、SLCK 和 DIN 的示波器波形(或在两个中发送 CS/SCLK 和 SCLK/DIN)、所有24位都在单帧中。 只是想确保其他一切都正常。  

     

    谢谢。

    Sanjay