您好、TI 专家、
我发现 DAVLID 变为高电平有效而不是低电平、并且在始终切换 CONV 后不会变为有效。
我 已经将模拟输入引脚与10kΩ Ω 电阻器和 GND 串联、如下：
但我在"测试 模式关闭"的情况下接收随机数据。
在"测试模式打开"中全部为零。
当我的客户发送命令以获取数据时、我只是在 DAVLID 移动后执行 DCLK 操作。
问题出在哪呢？
否则、什么会使 DAVLID 输出异常？
感谢您的答复。
您好、TI 专家。
现在、DVALID 工作正常、请遵循数据表。
但我 在"测试 模式关闭"中接收"所有0xFF"、并 连接了与10kΩ Ω 电阻器和 GND 串联的模拟输入引脚。
配置如下：
范围= 150pC
大家好、TI 专家 Eduardo Bartolome。
谢谢您的建议、让我更清楚地描述我的问题并添加一些详细信息。
1.起初我以为 DVALID 会正常工作、不管 DCLK 的状态如何、所以当我想把数据发送到 PC 软件时、我才刚移动 DCLK、直到我看到8.1概览。然后我开始在 DVALID 每次低电平后移动 DCLK、它使 DVALID 正确。
2.是的,它是 DCLK 作为标签显示在第二个帖子,第二张图片。
您是说 DVALID 应该在 DOUT 开始输出之前不断下降和上升吗？ DOUT 操作应持续1024*(1/8MHz)= 120us？
我需要把它读出来。
10kΩ 我的模拟输入设计器件如下所示。当样品送达时、SW1至 SW64将闭合。连接了与0 Ω 电阻器和 GND 串联的模拟输入引脚。
因为10.1上电时序要求显示"在器件上电之前、所有数字和模拟输入都必须为低电平"。
根据您的建议"输入端的10KOhm 接地有一定的风险"、我应该在电源稳定后将其移除或断开它吗？
5.代码4095?抱歉,我没有代码4095的相关信息。
感谢您的答复。
大家好！
<1> 是、DCLK = 8MHz。
<2> 当模拟输入悬空时、我收到零。
<3> 我已经检查了#3、这很 奇怪。
在某些情况下、DOUT 将在 DVALID 出现之前开始出现、如下所示：
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第一部分 DDC264：
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当模拟输入悬空时：
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当 连接与10kΩ Ω 电阻器和 GND 串联的模拟输入引脚时。除 IN20、21、23、24、25之外：
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当连接至 sample 时。1：
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当连接至 sample 时。2：
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第二部分 DDC264：
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当 悬空时：
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当连接至 sample 时。1：
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当连接至 sample 时。2：
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好日子，爱德华多
实际上我觉得现在一切都很好。 我很困惑、但我的同事指出、DDC264实际上会在降低 DVALID (请参阅图23)之前设置要传输的第一个 DOUT 位、并保持该状态、直到 DCLK 进入。 因此、如果第一个位为零、在第一个 DCLK 出现之前您不会在 DOUT 上看到任何转换... 但如果它为1、它将在 DVALID 之前切换并保持该状态、直到 DCLK 进入。 因此，您发送的所有数字似乎都正确。
感谢您的回复。我刚刚注意到图23。
DOUT 的长度也看起来很正确：16 x 64 / 8MHz = 128us。 最后一张图显示138us、所以有一点错误、但您的8MHz 可能不是正好是8MHz？
<1>蓝色是 DCLK,它的频率数据在图的左下角。光标是 DOUT,它在 DVALID 前面切换,一直保持到 DCLK 进入,所以显示138us。
在没有输入(#2)的情况下，它不应该是零，但应该是256 (20位中为4096，16b 模式中为256)。
<2>我不明白你的意思。但16位是65535在 DEC ?
电阻器(如果有)应饱和至零，而不是全部饱和。
<3>我在数据表中没有看到它应该饱和到零或全饱和。但我在测试模式中得到了零。
这是您的电路板还是我们的 EVM？
<4>它不是 EVM。
您是否将其放在屏蔽盒内？ 输入十分敏感、可以检测与其耦合的任何噪声。 不过， 我不认为这会显示为零。
<5>我不把它放在屏蔽盒内。有时我会得到大约 数百的数据输出。
您能用测试模式显示输出图吗？
<6>作为<3>
为什么要 为10k 案例附加4张图表？ 它们是否都相同？
<7>它只是一种显示格式,看起来清晰整洁。
您在样片之间有什么变化？ 我的意思是、样本零点似乎 卡住、但样本1看起来像是在切换(具有小输出代码)、而样本2看起来也在切换(但非常大)。 在没有任何连接到输入的情况下、您是如何实现如此大的变化的？ 更奇怪的是、第2个器件的行为是相同的。 怎么回事？ 两个设备是否独立？
<8>我的客户想要检查行为类似于电容器的样本的状态或质量。 我将其称为 C。因此、他们将为 C 充电一会儿、然后切换到 DDC264模拟输入、以查看可以向 C 充电的功率大小。样本1可能是糟糕的 C 或没有为足够的功率充电。
这两个器件是独立的。
此致、
jieyin。
Edu，你好。
很抱歉这么晚才回复。
<1>
在#5上、这并不明显、但如果您检查 DS、在电气特性表中、可以看到"负满标量程"为-0.4%。 这意味着逻辑输出零实际上是 FSR -0.4%的电流输入。 在代码中、即大约2^20 x 0.4%=~4095。 即、当输出是~4095代码(+/-偏移误差)时、输入实际为零电流。
我想我知道您的意思。您的意思是实际范围是-0.4%FSR ~ FSR (当-0.4%FSR、输出为零；0%FSR、输出2^16 * 0.4%= 261,100%FSR、输出65535时)。
但 FSR 是满量程范围、
。
我的意思是、如果我选择 Range3、
，
FSR 为15pC (157.5-142.5)。
因此、实际范围为142.44~157.5pC
当不是电流输入时、它的0pC 比142.44pC 低、这使输出为零是合理的。我说的对吗？
让我认为、当测试模式为3.3伏时、
输出零。
即使它有噪声、该噪声 看起来也太稳定、有意为之、以使输出保持为零。
<2>
但是我们来检查设备是否在正常模式下正常转换。 您能否在一个输入端和一个直流电源之间连接一个1或10M Ω 的电阻器、并使用直流电源施加电压？ 然后检查输出代码、看看它是否符合您的期望？ 例如、施加0.1V 电压和1M Ω-->输入电流将为0.1uA。 如果使用1ms 的 CONV、输入电荷将为100pc、在16b 模式下应该会产生大约23k 的输出代码。 尝试使用直流电源电压、以查看输出是您期望的结果...
这是个好主意,我会尝试它。
<3>
最后一件事，您能确认 CLK 的频率是多少吗？
CLK 为4MHz。
<4>
测试模式不能全为零。 它应接近代码256。 我们可能应该把重点放在这一点上、因为这隔离了很多东西。 不过、我想不出你在做什么才会发生这种情况。 您能否共享原理图？ 如果需要、您可以直接在我的电子邮件中执行此操作。 让我们进行 PM。 现在要去，但明天会回复剩下的[/报价]我无权向您发送整个原理图、但我可以稍后将部分原理图发布在您的网站上。
<5>
顺便说一下、我的客户想要重新设计 DDC264板、能不能就布局和其他方面提供一些建议？
感谢您的答复。
此致、
洁殷
Edu，你好。
<1>我已尝试在一个输入和0.002V 直流源之间连接1.8KOhm。当 CLK = 10MHz 时、TIN = 40'000us DCLK = 16MHz、测试64次、得到这些数字。
它似乎不稳定。
<2>关于测试模式,我不知道。我想当设置测试模式时,输入会从 DDC264上断开,所以没有什么东西能影响 DDC264的"实数输入",对吗? 电源是否会影响"实际输入"？
