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[参考译文] ADC3424:串行接口规范

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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1266455/adc3424-serial-interface-spec

器件型号:ADC3424

您能告诉我 ADC3424的串行接口规范吗?

 

根据 ADC3421-24.pdf P48表6、

fSCLK = 20MHz 最大值

tDSU = 25ns 最小值

TDH = 25ns 最小值

 

但是、当 fSCLK = 20MHz 时、该时钟时间(tSCLK)= 50ns、

而如果占空比为50%、时钟高电平时间= 25ns、时钟低电平时间= 25ns。

 

因此、TDSU 和 TDH 无法满足25ns 最小值。

(由于无法获得比时钟高/低电平时间更长的 tDSU/TDH。)

 

该规范是否指示我们无法以20MHz 频率运行此接口?

 

谢谢你。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Taku:

    可以、20MHz SPI 是此器件可能的最大串行接口速率。 如果在20MHz 下以精确的50%占空比运行、为了使其完全正常工作、理论上、您必须具有至少能够设置和保持25ns 的 SPI 驱动器。 在 SCLK 为低电平的整个时间内、驱动器必须使数据做好计时准备。 在 SCLK 为高电平时、驱动器必须保持数据。 这意味着需要数据的瞬时转换。 这在现实中可以实现吗? 对于大多数客户来说、答案是否定的。 某些客户的转换速率在 ps 范围内、此时20MHz SPI 将用于此器件。 实际上、数据表中的设置和保持时间规格高于器件实际运行所需的值。 而不是25ns 的设置和保持时间、想象成24.5ns 的设置和保持时间。

    如果应用可以容忍较慢的串行接口速度、则我强烈建议减小此值、以实现更易于使用的设计。 考虑到这是一个非常基本的器件、将不会有数百或数千个寄存器需要编程、 因此、提高20MHz 的 SPI 速度以及这样做时面临的挑战对于几十次寄存器写入的应用工作量级别与返回的结果之间是一个巨大的折衷。

    此致、Chase