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[参考译文] ADC08DJ3200EVM:环回问题

Guru**** 2382480 points
Other Parts Discussed in Thread: ADC08DJ3200EVM
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1274497/adc08dj3200evm-loopback-problem

器件型号:ADC08DJ3200EVM

大家好!

我正在尝试使用 JESD204 IP 来执行一个项目。 我最终会将 ADC08DJ3200EVM 插入 IP、但此刻我只能进行仿真和环回。 我稍微修改了代码以便只发送零、以便简化初始调试。 我使用的 zcu1012_8b10b 参考设计仅将 FPGA 更改为 Kintex UltraScale (KCU105)

回送效果很好、有任何信号都可以、但经过一段时间(222us)的仿真后、每个通道的最后2个字节不再是应有的那样。 这2个字节似乎是随机的,我没有看到任何重复。 我控制 Rx_LANE_DATA 和 TX_LANE_DATA。  

如果有人有想法,它会很受欢迎!

Étienne

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Etienne:

    我们在我们的设置中没有看到这个问题。 请告诉我、仿真是否在 JESD IP (IP 的 cfg_xx_扰 频_启用的输入)上启用或禁用了扰频。

    此致、

    艾米特

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    尊敬的 Amet:

    扰频已启用、当我禁用它时、只要 Rx 有效且值始终为0xFC、就会出现问题。

    此致、

    Étienne