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[参考译文] ADC12DJ5200-SP：如何使用时钟芯片 LMX2594RHAR 和 LMK04828BISQE/NOPB

admin
Guru**** 2380860 points
Other Parts Discussed in Thread: LMK04828, ADC12DJ5200-SP, LMX2594, LMK00304, ADC12DJ5200RF
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1454732/adc12dj5200-sp-how-to-use-clock-chip-lmx2594rhar-and-lmk04828bisqe-nopb

器件型号：ADC12DJ5200-SP
主题中讨论的其他器件： LMX2594、 LMK00304、LMK04828、 ADC12DJ5200RF

工具与软件：

您好！  

   我们使用2个 ADC12DJ5200-SP、并使用时钟芯片 LMX2594RHAR 和 LMK04828BISQE/NOPB、请帮助我们了解如何实现下图中的时钟输出。

 也有助于查看 ADC12DJ5200-SP 原理图、谢谢！

e2e.ti.com/.../DDH_5F00_1220.pdf

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    TI__Guru**** 2380860 points
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    您好！

    我在下面的计算中显示您处于1类同步模式、这意味着您不需要硬件同步信号。 您只需在编程时使用 SPI 接口来同步输出。 我为 ADC 团队提供支持、并且对此进行了最佳猜测、因此必须询问时钟团队是否需要将硬件同步信号用于 LMX2594。 为此、请使用 LMX2594器件型号、而不是将 ADC12DJ5200-SP 作为线程的主器件。

    LMX2594中也不需要 SYSREF。 由于您为第二个器件时钟使用了第二个输出、因此未使用该引脚。

    您具体希望从原理图中检查什么。 我目前无法查看这5个页面的全部内容、因此请提供一个简短的主要问题列表。

    谢谢

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    TI__Guru**** 2380860 points
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    大家好、 Chase：

      感谢您的快速回复！ 请查看 ADC 和时钟器件原理图。

    您能帮助我 根据我的时钟输出计算 LMK04828BISQE/NOPB 吗、谢谢！

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    TI__Guru**** 2380860 points
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    您好！

    ADC 部分看起来正常。 除了原理图中显示的时钟输出为156.25MHz、184.3MHz 和148.5MHz 之外、时钟似乎也不错。 单独在分配模式下运行 LMK 时将无法实现此目的。 要使用 PLL2、您需要将260MHz 基准连接到 OSCIN 输入。 我建议将 LMK00304的 CLKOUTB0 +/-输出路由到 OSCIN 引脚、以便能够支持这两个选项。 假设 LMX2594输出的偏置正确、其余电路看起来良好。 无需为 LMK 计算任何数据、您显示的是分频器为1的分配模式。 您有任何 ADC 问题吗？

    谢谢

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    TI__Guru**** 2380860 points
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    嗨、Chase、

      LMK04828 PLL2也使用了外部 VCXO、那么在我看来、OSCin 时钟是保留的、对吧？ 我更新了 sch、DCLKout clk all 260M、但 SDCLKout7和9 clk 是40.625M、这是如何实现的？ 我认为 SDCLKout 时钟与 DCLKout 时钟相同吗？

      非常感谢！

      e2e.ti.com/.../DDH_5F00_1224.pdf

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    TI__Guru**** 2380860 points
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    将其移至时钟团队以帮助评论。

    此致、

    Rob

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    你好、小丘、  
    我对您的问题有点困惑？
    在原理图中、我看到同时使用了 CLKinX 和 OSCIN。  
    CLKINx 路径连接到 PLL1、以驱动非常干净的 VCXO (通常用于抖动清除)、方法是利用非常窄的环路带宽使 VCXO 的相位噪声占主导地位并"抖动清除"。 如果参考时钟与 CLK 分布所需的 VCO 频率没有整数关系、PLL1也可用于频率转换。  

    如果您的参考时钟非常干净-您可以直接将一个260MHz CLK 馈入 OSCIN 以便为 PLL2创建一个2600MHz VCO 频率(VCO-0)、然后可以对其进行分频以创建10MHz CLKS。  

    该2600MHz VCO 频率也可以进行分频以生成40.625MHz SYSREF CLK。  

    我有点好奇- 32.5MHz clk 在 CLKin0的用途是什么？  
    此致、

    Vicente  

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    TI__Guru**** 2380860 points
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    Hi Vicente Flores Prado,

       我们希望使用 LMX2594、将两个频分5GHz 时钟输出到 ADC12DJ5200RFAVV、输入时钟156.25MHz、附件是原理图和 TICS 文件、如果可以、请帮助我、谢谢！

    e2e.ti.com/.../LMX2594.tcs

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    TI__Guru**** 2380860 points
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    你好、小丘、  

    请告知我们您计划将 JMODE 与 ADC 结合使用。

    我看到 ADC 的采样时钟频率是5.0GHz。

    此致、

    Rob

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    您好、Rob、ć

       ADC 使用 JMODE 45、谢谢！

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    你好、小丘、

    我已查看您的原理图和 TICS 文件、一切看起来都很好。 它的配置符合您的使用需求。

    关于 LMK04828、我要说您的当前配置可以正常工作、但前提是您使用的是单环路模式。 您需要将要同步到 VCO 的基准时钟输入到 OSC_IN 引脚。 我附加了一个 LMK04828配置、它应该能够指导您完成该过程。  

    e2e.ti.com/.../lmk04828_5F00_clocktree.tcs

    谢谢！

    Michael

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    明白了。 谢谢 Michael！

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    您好、 Michael：

       我想使用 FTDI 控制 TICS、但 FTDI 颜色是灰色的、不能选择、所以不能使用 TICS 程序 LMX2594、请帮忙检查、谢谢！

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    你好、小丘、  
    只有较旧的旧版 EVM 支持 LTDI。  
    TICSpro 器件配置文件经过硬编码、以便仅使用 US2ANY。  


    此致、  

    Vicente  

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    尊敬的 Rob：

      我们将调试 ADC12DJ5200RFAVV、电压为1.091V (VD11)、1.089V (VA11)、1.851V (VA19)、上电时无时钟输入(CLK+/-)、 初始功耗约为8W、输入时钟5G 到 ADC (CLK+/-)时、如果 ADC 工作不正常、功耗约为19W？ 以下是我们的原理图、请帮助您回顾一下、谢谢！

    e2e.ti.com/.../ADC12DJ5200RFAVV.pdf

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    你好、小丘、  

    我假设整个电路板的功率是19W？

    看起来有点高、除非 LDO 或电源上的大量电压/功率下降到1.1V 和1.9V。

    我觉得原理图很好。

    此致、

    Rob

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    尊敬的 Rob：

     整个板的电源为24W。  板上有两个时钟芯片和两个板载 ADC12DJ5200RFAVV 、ADC12DJ5200RFAVV 无 clk、全功率为12W、5G clk 为 ADC12DJ5200RFAVV、全功率为24W。 两个时钟芯片功耗为5W。 因此、 ADC12DJ5200RFAVV 的功率为19W。

     如果 ADC12DJ5200RFAVV 工作异常、功耗将更高。  VD11为1.09V、VA11为1.09V、VA19为1.851V。 这似乎不错、不会下降很多。

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    尊敬的 Rob：

       请向我们提供  ADC12DJ5200RFAVV 代码,我们使用这款芯片,需要软件,谢谢!

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    尊敬的 Rob：

       请向我们提供 JESD204C IP、使用 Intel FPGA AGIB027R31B 和两个 ADC  ADC12DJ5200RFAVV、谢谢！

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    尊敬的 Rob：

       数据表  ADC12DJ5200RFAVV、Jmode 45通道在两页侧有所不同。 哪项正确？

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    你好、小丘、  

    是的、这是数据表中的一个拼写错误。 有关 JMODE 的情况、请参阅表6-32。

    此致、

    Rob

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    尊敬的 Rob：

       根据 ADC12DJ5200RF EVM 的参考设计、电阻网络是低通滤波器、8.66 Ω-140 Ω-8.66 Ω、 信号带宽范围是多少？  请在 ADC 输入引脚上向我们提供内部电容器和电阻。

       谢谢！

     

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    你好、小丘、  

    此网络支持300kHz 至8.2GHz 频率范围内的信号 BW。

    内部 ADC 电容可在数据表规格中找到。

    还可以参阅 ADC12DJ5200RF 数据表。

    www.ti.com/.../adc12dj5200rf.pdf

    此致、

    Rob

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    尊敬的 Rob：

       我们使用参考网络和并联0.4pf 电容器连接到 GND、并联50 Ω 电阻连接到 GND。 仿真结果不是300K 到8.2G。 参数是什么呢？  

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    你好、小丘、  

    使用5200RF 网页上 TI.com 上的模拟输入参数。 这是执行仿真的更好方法。

    此致、

    Rob