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[参考译文] TCA9554:断电行为

Guru**** 2386610 points
Other Parts Discussed in Thread: TCA9554
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1511288/tca9554-power-down-behaviour

部件号:TCA9554

工具/软件:

你(们)好

如果 TCA9554的电源被移除、但有驱动 I/O 引脚的有源信号(3.3V CMOS)、会发生什么情况?
I/O 引脚是高阻抗、还是通过 I/O 引脚消耗电流?

感谢您的帮助!

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    IIOK 规格意味着 I/O 引脚具有连接到 VCC 的钳位二极管。 在任何情况下、电流都可能通过内部上拉电阻器泄漏。

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    尊敬的 Urban:

    请参阅 Clemens 回复。  

    此致、

    Tyler

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    是、但在断电时钳位到 Vcc 是否有效? 如果已通电并配置为输入、则钳位未激活(Vcc = 3.3V 可耐受5V)。

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    尊敬的 Urban:

    第二个注意事项是、当参考第6.3节"建议运行条件"时、该器件在 I/O 上似乎没有正钳位二极管。  

    当 VCC = 3V (min)时、P7-P0上的电压可高达5.5V。  

    电流仍将通过100k PU 泄漏、但电流会很小。  

    无论是上电还是断电、如果有引脚连接到 VCC 二极管、这都不应影响引脚。 在这个器件中、Pxx 引脚和 VCC 之间似乎没有一个正向 ESD 二极管。  

    此致、

    Tyler

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    嗨、Tyler
    如果端口配置为输出、上部 FET 会钳位到 Vcc。 这取决于该 FET 在断电模式下的行为。
    根据数据表:
    "8.3.1 I/O 端口
    当 I/O 配置为输入时、FET Q1和 Q2处于关闭状态、从而产生具有弱阻抗的高阻抗输入
    上拉(典型值为100 kΩ)至 VCC。 但是、输入电压可升高到高于 VCC、最大值为5.5V
    必须注意的是、由于集成了100 kΩ 上拉电阻、它可能会导致电流从 I/O 流向 VCC
    针脚(图15)。
    如果 I/O 配置为输出、则将启用 Q1或 Q2、具体取决于输出端口寄存器的状态。 In
    在这种情况下、I/O 引脚和 VCC 或 GND 之间存在低阻抗路径。 外部电压
    施加到此 I/O 引脚的电压不得超过建议的电平、才能确保正常运行。"

    此致、
    城市

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    尊敬的 Urban:

    您的解释是合理的、并且与数据表一致。  

    在断电时、I/O 不应配置为输出。 因此、该 I/O 只会在 GND 和引脚之间连接一个二极管、并在引脚和 VCC 之间连接一个100k Ω PU 电阻器。 除非器件通电且 I/O 配置为输出高电平、否则没有正钳位二极管。  

    此致、

    Tyler

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    好的、谢谢 Clemens 和 Tyler!

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    尊敬的 Urban:

    不用客气。 如果您有任何其他问题、敬请告知。  

    此致、

    Tyler