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[参考译文] DP83822I:超长数据包会导致解码器丢失锁

Guru**** 2847340 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1599387/dp83822i-extra-long-packet-causes-descrambler-to-lose-lock

器件型号: DP83822I

我们正在通过 100BASE-T 物理层尝试使用非常长(不符合 802.3 标准)的数据包、并会看到目标 PHY 上的解扰器在~18,600 个八位位组有效载荷后失去锁。

DP83822 PHY 配置为 RMII 主器件、弹性缓冲器旁路(恢复时钟模式)、恢复的 125MHz 时钟按预期显示在 RX_D3 上。

对于此测试、发送到 PHY 的每个半字节为 0x2、后者应在 PCS 之后提供完美的直流平衡 (4B/5B 代码“10100")“)。

电缆正常、无 EMI 干扰、在实验室条件下进行了测试。

系统在发送合法的以太网帧时表现出色。

 

  1. 考虑到理想的传入信号、什么可能导致解码器失去锁定?
  2. 理论上、是否应该能够在 PHY 级别发送/接收无限数据包?

 

此致、
Gordon

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    尊敬的 Gordon:  

    DP83822 时钟的 ppm 是多少?


    如果它是 100ppm、这可能是解码器失去锁的原因。
    理论上、PHY 可以接收/发送无限长的数据包、但这并不现实、因为 RMII FIFO 和 FIFO 具有其在 PHY 上可支持的最大大小。  

    此致、
    j

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    尊敬的 J:

    感谢您的快速答复。  XI 时钟为 20ppm。

    我的理解是、RMII FIFO 未用于 RMII 恢复时钟模式。 此配置是否允许同步以太网配置?

    寄存器 0x0017 设置为 0x0021、因此 B6(RMII 恢复时钟异步 FIFO 旁路)为“0",“,从而、从而绕过 FIFO。  
    我们可以看到 DP83822 的 50MHz RX_CLK 输出、这表明 PHY 能够识别该配置。
    当我们读取寄存器时、没有指示 RX FIFO 上溢或下溢 (b[3:2])。

    因此、发生失锁后、除扰频器锁定丢失位(寄存器 0x0010、b9)之外、整个寄存器映射中没有显示故障指示。

    此致、
    Gordon

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    尊敬的 Gordon:  

    我明白了。 您的理解是、在 RMII 恢复时钟模式下未使用 RMII FIFO、这是正确的。 SyncE 只需配置待输出的 125MHz。  

    PHY 仅测试了高达 13.5k 字节的数据包、因此您正在测试的数据包的当前大小可能对于我们的 PHY 来说太大。  

    请参阅以下链接、了解我们的 PHY 测试条件:
    DP83867CS:巨型帧支持 — 接口论坛-接口 — TI E2E 支持论坛

    此致、
    j

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    尊敬的 J:

    谢谢你。  我很感激我们将器件推向超出规格范围 — 但仍想知道哪些因素会导致解扰器失去锁定。  不管缓冲区大小或我们使用的其他参数如何,它似乎总是在 18.6kB 时失败,因此这个问题感觉是数字的而不是模拟的。  

    是否有任何内部计数器复位扰频器而可能导致失锁?

    此致、
    Gordon

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    尊敬的 Gordon:  

    遗憾的是、我没有发现会导致解码器失去锁的内部计数器。 这似乎是一个模拟问题、我怀疑可能存在用于解扰器的内部缓冲器 溢出。 这种溢出可能会导致 PHY 在 18.6kB 时持续失败。 我建议将数据包大小保持在 13.5kB 以内、因为这是我们这边验证的最大数据包大小  

    此致、
    j