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[参考译文] DP83867IS:链路建立问题

Guru**** 2789075 points

Other Parts Discussed in Thread: DP83867IS

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1621336/dp83867is-linkup-issue

器件型号: DP83867IS

尊敬的技术支持团队:

 

DP83867IS 通过 RGMII 连接到 Zynq (PS-MIO)、它存在链路问题。

您能建议我建立联系吗?

 

DP83867IS 根据配置 (strap) 设置确定其启动行为、如下所示:

RX_D2:用 1k Ω 下拉

RX_D0:用 1k Ω 下拉

RX_CTRL:使用电阻分压器设置为模式 3

INT/PWDN:使用 2.2k Ω 上拉

 

VDDIO 由外部供电 、电压为 1.8V。由于这是一种双‑电源配置、VDDA1P8 处于开路状态。

 

 

使用 4 级配置 (strap) 配置以太网器件(修订版 A)

DP83867 疑难解答指南(修订版 C)

www.ti.com/.../slvrbn1

此致、

TTD

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    您好、  

    您能否分享原理图以便检查硬件连接? 此外、您能否验证 PHY 是否处于活动状态? 您能否检查 PWDN、RST_N 为高电平、XI 引脚正在获取 25MHz 时钟? PHY 是否根据功率斜坡要求上电?

    此致、
    j

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    尊敬的 J:

    我可以实现链路连接、这是由于电缆连接问题而导致的。

    感谢您的支持。

    我还有一个问题。

    关于 DP83867IS 的 RGMII 规格、
    是 LVCMOS 吗? 还是 HSTL?
    目前、VDDIO 设置为+1.8V、因此 VOH 从 VIH/VIL 和 LVCMOS/LVCMOS 角度来看、它看起来相当于 VOL。

    输出电平
    VOH 1.6V 或更高
      VOL 0.2V 或更低

    输入电平 (VIH/VIL)
     VIH 1.26V 或更高
     VIL 0.36V 或更低

    在 FPGA 中、我选择了 LVCMOS 1.8V 并通过 RGMII 进行连接。  

    此致、

    TTD

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    尊敬的 TTD:  

    DP83867 上的 RGMII 使用 LVCMOS。  

    此致、
    j