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[参考译文] LMH0397:SDI 布局回顾

Guru**** 2521970 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1031374/lmh0397-sdi-layout-review

器件型号:LMH0397

您好!

我正在设计3G SDI 输出和输入接口时使用 LMH0397RTVT IC。 我将使用 来自 Samtec 的 BNC 连接器 BNC7T-J-P-GN-RA-BH2D。 我已通过两种不同的方法为此 IC 设计了布局。

方法1:75 Ω 阻抗信号在 N-2层中具有接地基准。 根据堆叠、N-1层中提供了禁止

方法2:75欧姆阻抗信号在 N-2层中具有接地基准、但36mil 的信号布线长度 没有 接地基准。

SDI 输出和输入接口的布局设计将相似。 我附加了 SDI 输入接口的布局设计。 我已附上原理图 并进行堆叠 以供参考。

您能否查看 为这两种方法提供的布局文件、并让我们知道我们应该考虑并继续进行的正确布局设计。 另外、请告诉我们 您对改进布局设计的建议。

提前感谢!e2e.ti.com/.../iW_2D00_EMFCY_2D00_BF_2D00_01_2D00_R1_5F00_0_2D00_REL1_5F00_0_5F00_27_2D00_08_2D00_2021_2D00_1900_2D00_SDI_2D00_APPROACH1.PcbDoce2e.ti.com/.../APPROACH2.pdfe2e.ti.com/.../UPDATED_2D00_APPROACH-1.pdfe2e.ti.com/.../iW_2D00_EMFCY_2D00_BF_2D00_01_2D00_R1_5F00_0_2D00_REL1_5F00_0_5F00_27_2D00_08_2D00_2021_2D00_1900_2D00_SDI_2D00_APPROACH2.PcbDoce2e.ti.com/.../IWAVE_2D00_8LAY_2D00_08JUNE2021_2D00_21364.pdf

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    HI Shiftalli、

    请注意以下几点:

    1)。 原理图看起来不错。

    2)。 通常、在高速引脚和元件焊盘下、我们会出现空洞。 这意味着这些器件下没有 GND 或 VCC。 查看您的 PCB 布局、似乎有一些 GND 层。 如果没有空、则会导致阻抗下降。 在3G 下、这可能不是一件大事、但我们通常在设计中使用此指南。 我相信数据表中的 PCB 布局指南也提到了这一点。

    3)。 我们通常使用的高速布线会产生这种电弧-这意味着我们没有急转弯。 在100欧姆信号上、您似乎具有如此急剧的转向。 同样、这可能不是一个主要问题、但我们通常避免这些急转弯。

    4)。 请注意数据表的图36。 我不清楚焊锡膏使用四个方形。 我看到过孔、但不看到焊锡膏。

    此致、、Nasser

     -  

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    您好、Nasser、

    上述共享注释是通用布局指南。 感谢您分享这些指南。 我希望您对我分享的布局设计提供反馈。

    在我共享的方法之一中、75欧姆阻抗信号以布线长度254mil 从驱动器 IC 路由到第8层(底层)中的 SDI 连接器。
    根据堆叠,第6层中提供了接地基准。 空存在于 layer1到 layer5和 layer7中。 在 SDI 75欧姆信号的254mil 迹线中、36mil 迹线在第6层中不会有任何接地参考。
    36密耳的迹线将会有空隙。  这是可以接受的。 不会存在任何阻抗不匹配。

    重新附加图像以供参考。 在所附的图像中、我突出显示了信号中不会出现接地基准行为且完全无效的部分。 请提供您的输入内容。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    HI Shiftalli、

    在我们的设计中、我们始终提供参考平面并防止任何阻抗不连续性-即使布线长度为36mil。 在这种情况下、即3G SDI、该布线会进入 BNC 连接器、而这种更高的阻抗可能会补偿 BNC 引脚的反焊盘。 建议联系您的 BNC 连接器供应商、获取他们的意见、以获得最佳的 BNC 连接器反焊盘。  

    此致,Nasser