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[参考译文] DP83826I:如何在不使用自举电阻器的情况下配置启动

Guru**** 2393335 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1036865/dp83826i-how-to-configure-startup-without-strapping-resistors

器件型号:DP83826I
主题中讨论的其他器件:DP83869

大家好、

我的客户需要一些帮助来了解他们正在使用的以太网 PHY 的自举电阻器。 如果 他们选择不使用自举电阻器、他们还希望获得有关无自举电阻器的最佳启动方法的指导。

他们将在增强模式下配置 PHY。 根据数据表的第6页、该文档显示保留此 NC。 它们将在 RMII 从模式、100BASE-TX 模式下使用芯片、并启用 Auto-MDIX。 如果没有搭接、器件看起来将配置为 MII 模式、这不 是他们想要的。

查看 DP83826 EVM、引脚28是 Strap4。 数据表显示它是一个 PD (下拉)引脚。 第15页的图14显示了 EVM 的原理图。 引脚28连接到包含 R56的电路。  R56的用途是什么?  该引脚上有一个内部下拉电阻器、电路中没有正驱动力。  表中的其他元件显示为"DNP"、因此该电阻器应该被组装。

假设他们不想担心自举电阻器、他们应该遵循什么程序来确保干净启动? 这就是他们的想法-

1.通电。  PHY 的 RST_N 输入为低电平(有效)。
2.微控制器启动。
3.微控制器打开50MHz 时钟以进行 RMII 从机操作。 该微控制器具有用于此目的的时钟输出。
4、微控制器将 RST_N 置为无效 它们假设如果器件处于复位状态(是否为真?)、SMI (MDC/MDIO)将不起作用。

 他们所关心的是、PHY 变得栩栩如生、并与外部器件协商、只需复位即可在不同的模式下运行。 是否可以在器件开始在 RD/TD 引脚上进行外部通信之前通过其寄存器配置器件? 从时序图中可以看出、SMI 总线需要50 MHz 时钟才能运行、否则可以在器件能够运行之前对器件的寄存器进行编程。 是否是将 RST_N 信号置为无效、然后对禁用芯片的寄存器进行快速编程的最佳方法? 然后对所有寄存器进行编程、然后允许芯片运行?

谢谢、
劳伦

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Lauren、

    要回答您的问题:

    • 正确、对于增强模式、ModeSelect 引脚可以保持 NC。
    • 复位期间、寄存器访问将不可用。  
    • 正确、默认 MAC 接口为 MII 模式。  这可以在 POR 之后通过寄存器或通过硬件搭接进行调节  
      •  通过 RX_D2实现硬件自举
        • 模式0 = MII
        • 模式1 = RMII
      • 寄存器0x17[5]
        • 0b =使能 MII 运行模式
        • 1b =使能 RMII 运行模式

    如果通过寄存器调整 MAC 接口、建议在脚本末尾发出一个软件复位(写入寄存器0x1F = 0x4000)。 这将在不擦除寄存器写入的情况下重新启动 PHY。  

    如果您有任何疑问、请告诉我。  

    谢谢、

    Nikhil

    此通信和任何相关通信中的所有信息均按“原样”和“不含任何瑕疵”提供,并受 TI 的重要声明(http://www.ti.com/corp/docs/legal/important-notice.shtml)约束。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Nikhil、

    谢谢、这有助于解决他们的所有问题、但并非所有问题都得到了解答。 他们希望了解 PHY 电缆侧在上电时会发生什么情况。 在软件能够配置和软复位器件之前、是否会建立链路?  是数据表底部第29页的答案-在中、PWRDN 引脚似乎应用于将芯片置于断电状态、直到处理器有时间配置寄存器。 是这样吗?  否则、PHY 将运行并与它连接的任何设备进行协商?

    您能否得到有关在 PWRDN 被置为有效时、为了使 SMI 正常工作、是否需要激活50MHz 时钟的说明? 如果您能回答有关 EVM 原理图的问题-有关 R56用途的问题、我也会不胜感激。

    谢谢!
    劳伦

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    您好 Lauren、

    您的评估正确。 上电后 、如果电缆的另一端有兼容的链路伙伴、将自动进行自动协商、并建立链路。 PWDN 可保持低电平、直到完成所有寄存器配置。 50 MHz XI 时钟需要激活才能使用任何 PHY 功能。  

    引脚28可配置为 LED。  当 LED 引脚用作自举时、需要进行并联拉。 遗憾 的是、DP83826数据表中遗漏了此信息、但您可以参阅 DP83869数据表中的第9.5.2节。 同样的概念也适用。 如果不将 LED 引脚配置为自举、则无需并联拉、该引脚可仅用作 LED、串联470欧姆电阻器即可。  

    您指的是哪种 EVM 原理图? 以下链接中 EVM 用户指南中的原理图: https://www.ti.com/lit/ug/snlu262/snlu262.pdf?ts=1632331494623&ref_url=https%253A%252F%252Fwww.ti.com%252Fproduct%252FDP83826I ?

    谢谢、

    Nikhil

    此通信和任何相关通信中的所有信息均按“原样”和“不含任何瑕疵”提供,并受 TI 的重要声明(http://www.ti.com/corp/docs/legal/important-notice.shtml)约束。

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    您好、Nikhil、

    是的、这是您共享的链接上的原理图-问题与 R56有关。 它的目的是什么? 该引脚上有一个内部下拉电阻器、电路中没有正驱动力。 表中的其他元件显示为"DNP"、因此该电阻器应该被组装。

     

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Lauren、

    已理解、请参阅我上面有关 R56 LED 搭接的评论: 引脚28可配置为 LED。  当 LED 引脚用作自举时、需要进行并联拉。 遗憾 的是、DP83826数据表中遗漏了此信息、但您可以参阅 DP83869数据表中的第9.5.2节。 同样的概念也适用。 如果不将 LED 引脚配置为自举、则无需并联拉、该引脚可仅用作 LED、串联470欧姆电阻器即可。  

    这是否完全回答了问题?

    谢谢、

    Nikhil

    此通信和任何相关通信中的所有信息均按“原样”和“不含任何瑕疵”提供,并受 TI 的重要声明(http://www.ti.com/corp/docs/legal/important-notice.shtml)约束。

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    您好 Lauren、

    如果您有任何疑问、请告诉我。 否则、我将关闭该线程。

    谢谢、

    Nikhil

    此通信和任何相关通信中的所有信息均按“原样”和“不含任何瑕疵”提供,并受 TI 的重要声明(http://www.ti.com/corp/docs/legal/important-notice.shtml)约束。

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    您好 Lauren、

    我将关闭该线程。 请根据需要启动新主题帖。

    此致、

    Sreenivasa