您好!
我们在新设计中使用 TLIN2029。
我们将在 IC 的 TXD 引脚上发送1KHz 信号。 我们在 LIN 引脚上获得1KHz 信号。 我们预计 RXD 引脚中会出现2.5V、1KHz 信号。 但我们将获得1KHz、但我们的电压仅为1.8V。 RXD 引脚为开漏输出引脚。 我们使用10K 上拉至2.5V。
因此、我们期望 RXD 上具有2.5V 信号。
请在这方面提供帮助。
连接原理图
谢谢
Joseph George
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您好!
我们在新设计中使用 TLIN2029。
我们将在 IC 的 TXD 引脚上发送1KHz 信号。 我们在 LIN 引脚上获得1KHz 信号。 我们预计 RXD 引脚中会出现2.5V、1KHz 信号。 但我们将获得1KHz、但我们的电压仅为1.8V。 RXD 引脚为开漏输出引脚。 我们使用10K 上拉至2.5V。
因此、我们期望 RXD 上具有2.5V 信号。
请在这方面提供帮助。
连接原理图
谢谢
Joseph George
Joseph、
是否有关于 LIN_RX_OUT 网络连接到什么的信息? kΩ kΩ 级、特别是某些 I/O 扩展器、具有弱偏置、可能会以10 μ V 至50 μ V 的电流将信号下拉、这有助于解释这种行为。
关于 RXD 的灌电流强度、其最小下拉电流强度(1.5mA)将决定 RXD 上足够低的低电平电压。 它不会影响高电平电压、因为 RXD 在隐性信号期间具有高阻抗。
最棒的
Danny Bacic
您好!
感谢您的更新。
是的、此信号连接到 FPGA IO 引脚。 我们已将该引脚作为输入、并且未提供任何上拉或下拉选项。
我还介绍了 EVK 原理图、其中上拉电阻器连接到3.3V。 在我们的原理图中、它连接到2.5V。 但由于 RXD 引脚是漏极开路输出、因此无关紧要。(期望 VDS>VGS-Vth 和 Vgs>Vth)。
那么、我们是否可以使 RXD 灌入2.5mA?(电压对我们来说是可以的)
谢谢
Joseph George
Joseph、
[引用 userid="427760" URL"~/support/interface-group/interface/f/interface-forum/1039101/tlin2029a-q1-we-are-getting-only-1-8v-in-rxd-pin/3845652 #3845652"]但由于 RXD 引脚是漏极开路输出,因此无关紧要。(预期 VDS>VGS-Vth 和 Vgs>Vth)。我同意你的意见。 您是否有任何示波器测量数据、我们可以查看这些数据来尝试和诊断这些数据? 当您观察到这种行为时、RXD 信号的形状是什么? 您是否看到了相对平坦的方波、或者它是否看起来更接近锯齿波形?
[引用 userid="427760" URL"~/support/interface-group/interface/f/interface-forum/1039101/tlin2029a-q1-we-are-getting-only-1-8v-in-rxd-pin/3845652 #3845652"]我们是否可以使 RXD 灌入2.5mA 电流?(对我们来说卷正常)我们没有对 RXD 引脚在所有尺寸上的完整频谱表征、但可以保证在下拉时、如果 RXD 引脚保持在0.4V、则该引脚将灌入 至少1.5mA 以保持该电压。 考虑这一点的另一种方法是、若要使 RXD 灌电流为1.5mA、您无需使 RXD 高于0.4V。在我们的一些测试中、我们会看到具有足够强的下拉电阻的器件、它们在0.4V 时可以灌电流为2.5mA 或更高、 但器件之间存在差异。 0.4V 时的唯一保证是它可以满足1.5mA 下拉强度。
如果您在担心损坏之前询问引脚可以处理的最高电流、则这将低于绝对最大额定值的 IO 参数-它可以处理高达8mA 的电流。
最棒的
Danny
Joseph、
有趣-因此听起来像是与 RC 相关的问题。 锯齿形向我表明、高电平电压在1.8V 时不会变得"稳定"、而是在再次下拉之前仅上升到1.8V。
我今天无法测试这种情况、但在接下来的几天里、我想将其汇总在一起、正如您所说的、看看我是否可以复制这种行为。 我同意,很高兴看到我们是否可以为这一观察找出原因。 如 Eric Hackett kΩ 的那样、EVM 上的10k Ω 电阻器已成为我们用例的标准配置。
一旦我有机会测试这个、我将在这里跟进。 同时、如果您有任何其他问题、请告知我。