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[参考译文] DS15BA101：RVO 引脚上的可接受电容值

admin
Guru**** 2524550 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1001875/ds15ba101-acceptable-capacitance-value-at-rvo-pin

器件型号：DS15BA101

你(们)好

数据表提到 、应移除 RVO 网络以最大限度地减小寄生电容。   
如果 RVO 引脚和 VCC 之间的电阻由数字电位计控制、电位计引脚之间的电容为40至90pF、那么电容值是否可以接受？

此致、Taki   

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    TI__Guru**** 2524550 points
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    您好！

    这一情况尚未确定。 我们通常移除该引脚下的 GND 或 VCC 以减少寄生。 然而、40pF 至90pF 是高电平、但如前所述、这一特性并未得到表征。

    此致、Nasser

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    TI__Guru**** 2524550 points
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    您好、Nasser、
    感谢你的答复。

    我明白了。

    如果在 RVO 引脚上添加了寄生电容、会发生什么情况？  

    此致、Taki

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    TI__Guru**** 2524550 points
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    您好！

    这是内部模拟电路的基准电压。 额外的寄生电容可能会将系统/板级噪声注入到该参考电源中、从而导致输出信号出现噪声/抖动。

    此致、Nasser

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    TI__Guru**** 2524550 points
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    您好、Nasser、
    我明白了。

    我想使用电位器降低噪声、在 RVO 引脚和电位器之间添加一个电阻器、并且额外的电阻值应该尽可能高。  您是否认为这个想法可以减少噪声？

    此致、Taki

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    TI__Guru**** 2524550 points
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    您好、Taki、

    理论上、该串联电阻器应该有助于衰减噪声-请注意、该电阻器垫也会增加寄生。 但是、我没有看到任何采用此配置的设计、我们会注意到这些设计。  

    此致、Nasser