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[参考译文] DS90UB928Q-Q1:DS90UB928上的像素时钟问题

Guru**** 2582155 points
Other Parts Discussed in Thread: ALP

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/998968/ds90ub928q-q1-pixel-clock-issue-on-ds90ub928

器件型号:DS90UB928Q-Q1
主题中讨论的其他器件:ALP

大家好、

在评估 DS90UB928时遇到问题:

系统方框图如下:

现在面临的问题:

在 PCLK 上读取的 ALP 数据在928和949之间的差异:

PC 端的输出设置:

支持需求:

您能不能为将928上的 PCLK 调整为 PC 侧输出设置提供一些建议

BR

Brandon

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    您好、Brandon、

    这是预期行为。 928侧的 PCLK 频率检测电路通常比949侧的精度低、因为它们在每侧使用不同的机制来检测时钟速率。 如果您要在示波器上进行检查、这些器件报告不同的频率是没有问题的、并且每侧 PCLK 的实际测量频率将是相同的。

    此致、

    Casey  

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    您好、Casey、

    实际上、我们遇到了一个无法从 HUD 侧获取信号或图像的问题。 我可以在下面附上相关的寄存器、您能帮助检查原因还是根本原因吗?

    系统块:

    DLP230的信号要求:

    PC 端的参数:

    929和928上的寄存器信息

    e2e.ti.com/.../Register-related.docx

    您可以帮助分析吗?  非常感谢!

    BR

    Brandon。

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    您好、Brandon、

    我注意到的一点是、源为水平前沿提供30像素、但显示需要40像素。 您可以进行调整吗? 另外、DLP230的 HSYNC/VSYNC 预期极性是多少? 除此之外、从 ALP 和寄存器转储中可以看到 SERDES 之间的视频链正在工作、并且具有正确的 PCLK 速率。 是否需要对 DLP230进行一些编程?

    此致、

    Casey  

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    您好、Casey、

    我们发现还有其他具有  DS90UB928的连接设备、其地址为0x34、如949所示。

    1)是否有影响影响信号链路?

    2) 2)设置928后、我们对949进行电源复位、视频信号可能从928显示。 但 ALP 显示状态仍为取消链接。

    我需要通过 I2C 设置949、您是否能帮助分析上述情况?

    BR

    Brandon  

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    您好、Zhanpeng、

    您说928与 I2C 总线上的另一个器件具有相同的 I2C 地址吗? 只要 I2C 地址不同、就可以、并且不会影响操作。 您能否分享您询问的新设置的屏幕截图、了解显示视频在何处显示、但设备状态报告在 ALP 中未链接?

    此致、

    Casey