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[参考译文] XIO2001:XIO2001上电问题

Guru**** 2529350 points
Other Parts Discussed in Thread: XIO2001

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/892605/xio2001-xio2001-power-up-problem

器件型号:XIO2001

您好!

我使用 XIO2001进行了一项设计、该设计基于 TI 的 EVM 板进行设计、我的板上电时出现问题:

由于我需要将其用作简单的 PCIe 至 PCI 桥接器、因此我不使用 EPROM 来配置器件。 基于 EVM 板(J1接头上的引脚9是 XIO2001的全局复位(GRST)。 将这个引脚驱动为低电平将导致 XIO2001内的所有寄存器和状态机返回到一个缺省加电状态。 此引脚通常必须保持断开状态。")  根据实施指南:(“在 XIO2001器件从 D3cold 电源状态加电期间,不需要将此端子置为低电平”),我将 GRST 引脚悬空。

打开 PC 时、PC 似乎会冻结。 开机时、PERSTn 信号从低电平变为高 电平。  如果 我手动将 PERSTn 信号置为有效和降级(GND 至3.3V) 、 则 PC 会继续启动、但在设备管理器中、网桥会出现代码12。 我在几台 PC 上试用过它。  

我还尝试向 PERSTn 信号添加一些延迟、但没有改变。

我在支持论坛中尝试了一些解决方案、但没有成功。  

请告知、

此致、

Yossy Goldenberg

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    您好 Yossy、

    请您分享您的原理图以便我们进行审阅吗?

    您能否检查加电顺序并确保其遵循数据表中提供的建议?

    此致、

    Davor

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    您好、Davor、

    感谢您的重播和支持。

    请找到我的 XIO2001原理图。 我的设计基于未连接 GRSTN 的 TI EVM 板。 我尝试向该信号添加电容器、并设法对上电序列进行速率调节、如数据表第22页所示(目前由于 Corona 的原因、我们正在在家工作、无法发送示波器图像)、  

    请注意,我有短接信号 SCL 和 SDA。 它们在原理图中浮动。

    e2e.ti.com/.../bridge.pdf

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    Jossy、您好!

    下面是我对原理图的评论:

    VDD_15_PLL 引脚必须与 VDD_15引脚的其余部分隔离。

    如果不需要外部 EEPROM、则必须将 GPIO4/SCL 拉低(看起来您已经解决了这个问题)。

    -GRST#必须遵循数据表中描述的加电顺序。  TI EVM 不符合此要求、但仍然工作正常。  但是、我们看到客户反馈由于电源轨噪声而出现问题、他们能够通过满足 GRST#时序来解决问题。

    此致、

    Davor

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    您好、Davor、

    非常感谢您的帮助。

    我的设计基于以下论坛讨论中的 EVM 修订版 C 文件:  XIO2001 支持与培训网页中的 e2e.ti.com/.../2617061 在这些文件中、PLL 未被过滤。 在 EVM 网页中、EVN 原理图的链接显示为修订版 B、而 实际上是修订版 D、但我之前没有检查过、因为我确定修订版 C 比修订版 B 更新。我的错误。

    我打算做一个新的布局。 除了 EVM 中的电感器外、您是否可以推荐使用 π 型滤波器电感器、这 对于我的设计来说非常重要、但并不常见?  除了200mA 和220欧姆@ 100Mhz 之外、电感器还有其他建议吗?

    感谢你的善意帮助。

    此致、

    Yossy Goldenberg

     

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    您好 Yossy、

    除了额定电流和100MHz 时的220 Ω 阻抗外、电感器应具有50毫欧或更低的 DCR。  

    此致、

    Davor

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    您好、Davor、

    非常感谢您的支持!

    Yossy