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Other Parts Discussed in Thread: DP83867IR
https://e2e.ti.com/support/interface-group/interface/f/interface-forum/961137/dp83867ir-link-down-conditions-of-100m
大家好、
通过以100M 全双工的媒体速度与链路合作伙伴建立链路、我们的板每隔几个小时就会断开一次。
链路伙伴侧不会断开连接。
您能告诉我100Base-Tx 的链路断开条件吗？
此致
Ryo
您好 Ryo、
当 PHY 链路断开时、链路是否会保持断开、或者是否会再次恢复并恢复数据传输？ 如果您在下行链路期间具有寄存器访问权限、您能否提供以下寄存器的读数：
此外、您能否提供原理图？
谢谢、
Nikhil
您好、Nikhil、
感谢你的答复。
在这种情况下、由于链路再次恢复并恢复数据传输、我无法在链路断开期间读取寄存器。
随附：原理图
/cfs-file/__key/communityserver-discussions-components-files/138/4212.Schamatic_5F00_Layout.pdf
此致、
即使在链路断开或未连接链路伙伴时、如果 PHY 正确上电、寄存器访问也应可用。 我将在星期一之前查看布局并提供反馈。
我在链路处于100M 时转储了寄存器。
DUT： 自动协商:开 10/100/1000M：支持 半双工/全双工：支持 Auto-MDI/MDI-X：支持
链接合作伙伴： 自动协商:开 10/100M：支持 半双工/全双工：支持 Auto-MDI/MDI-X：支持
//
0h 1100 1h 796D 2h 2000 3h A231 4h 01E1 5h 41E1 6h 0067 7h 2001年 8h 0000 9H 0200 啊0000 BH 0000 通道0000 DH 401F EH 0C5F FH 3000 10h D068 11h 6F02 12h 0000 13h 1C40 14h 29C7 15h 0000 16h 0000 17h 0040 18h 6B50 19h 4444 1AH 0002. 1Bh 0000 1通道0000 1DH 0000 1Eh 0002. 1Fh 0000 32h 00D3 6Eh 0000 6Fh 0100
感谢您提供详细的寄存器转储。 我将查看原理图和寄存器转储、并将在星期一之前提供反馈。
一些后续问题：
1.您是否正在写入寄存器？ 寄存器0x0的默认值应为0x1140。 在链路建立之前、寄存器0x0的值是多少、而不连接链路伙伴？
2.在连接到链路伙伴之前，您是否可以在上电时提供寄存器转储？
从原理图和寄存器转储中可以看到、所有自举都是默认的、只有放置自举才能在模式3中设置 RX_CTRL。 您能否确认未放置其他绑带？
您好、Nikhill、
答案1.
是的、在粉末上升后、写入到一个 regisgers
跟随转储、无写入。
0h 3100 1h 7949 2h 2000 3h A231 4h 01E1 5h 0000 6h 0064 7h 2001年 8h 0000 9H 0200 啊0000 BH 0000 通道0000 DH 401F EH 00D3 FH 3000 10h D048 11h 0002 12h 0000 13h 0040 14h 29C7 15h 0000 16h 0000 17h 0040 18h 6B50 19h 4444 1AH 0002. 1Bh 0000 1通道0000 1DH 0000 1Eh 0002. 1Fh 0000 32h 00D3 6Eh 0000 6Fh 0100
答案2.
0h 3100 1h 7949 2h 2000 3h A231 4h 01E1 5h 0000 6h 0064 7h 2001年 8h 0000 9H 0200 啊0000 BH 0000 通道0000 DH 401F EH 0C5F FH 3000 10h D048 11h 0002 12h 0000 13h 0040 14h 29C7 15h 0000 16h 0000 17h 0040 18h 6B50 19h 4444 1AH 0002. 1Bh 0000 1通道0000 1DH 0000 1Eh 0002. 1Fh 0000 32h 00D3 6Eh 0000 6Fh 0100
答案3.
我确认除了 RX_CTRL 之外、没有其他搭接。
在进一步审阅原理图后、我注意到使用了外部时钟源。 时钟的电压电平是多少？
时钟的电压电平：
VH = 1.77V
VL = 0.05V
参考数据表中的 P111 (9.2.1.2时钟输入(XI)建议)进行设计。
显示附加文件：
/cfs-file/__key/communityserver-discussions-components-files/138/Clock_5F00_Level.pptx
我们将研究此问题、并将在星期四之前提供反馈。
这是一个很难调试的问题、因为链路中断是间歇性的、链路自动恢复、数据传输恢复、并且每隔几个小时只会出现一次、这是不可重复的。 此外、由于我们无法在链路断开状态期间获取寄存器转储、因此这会更加困难。 就下行链路事件的原因而言、可能有多种原因。 这可能是信号质量问题、时钟问题等 SI 问题的可能原因包括但不限于长布线、差分布线阻抗控制不正确或长度匹配不正确、串扰、长电缆或连接器问题。 目前、我没有看到原理图或寄存器转储方面的任何问题、在寄存器转储发生期间、正常数据传输可以确认这些问题。
时钟源是否符合数据表中第9.2.1.2节所强调的要求？
您是否能够共享布局？
我认为时钟源符合要求。
时钟源规格和布局： 请参阅以下附件
/cfs-file/__key/communityserver-discussions-components-files/138/Schamatic_5F00_Layout3.pdf
在正常运行中、FLD 功能被关闭、 由于调试、当启用 FLD 时、在1秒内重复进行上行和下行链路。 wirte 0x002d [4：0]= 0x1f 读取0x002d [12：8]= 5'b00110 MLT3误差和 SNR 水平处于活动状态
这仅适用于某些链接伙伴。 DP83867IR 的评估板也是如此。
从这个结果中、我们认为输入信号的信号质量是原因。
当禁用 FLD 时、相同的因子(MLT3误差和 SNR 级别)是否可能会导致链路每隔几小时断开一次？
我们将研究此问题、并将在星期一之前提供反馈。
使用 FLD 功能时、您似乎已将此范围缩小为 SNR 和 MLT3问题。 同样、这可能是由有损耗的电缆或连接器引起的、也可能是布局中的非理想因素、例如 MDI 信号中的噪声或耦合或 MDI 布线中不正确的差分控制阻抗。 您目前是否能够共享 PCB 布局？
进一步审查原理图后、可能需要更新电源引脚去耦策略。 每个电源引脚应在引脚附近有一个0.1uF 和1uF 电容器、并且每个电源还应有一个10nF 和10uF 电容器。 请参阅数据表中的图37。 电源噪声可能会导致 SNR 问题。
它。 请告诉我们您所需的数据格式和您要参考的区域。 PHY 周围每一层的布局等
我考虑了该电源引脚去耦策略。
Ryo。
如果可能、请提供要查看的布局设计文件。 如果无法公开共享这些内容、您可以通过私人消息共享。 我已发送连接请求。 如果可能、我想查看网络名称和布线长度/属性。 请至少共享可搜索的原理图、布局和装配图、以便我可以将原理图上的组件映射到布局中的位置。
在平均时间内、请尝试推荐的去耦策略。
